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1、第1讲 可编程逻辑器件原理水声工程学院课程简介n数字电子技术电路为基础：复习数字电路的基本原理，并与可编程逻辑器件原理相结合。nCPLD/FPGA设计及应用：面向实际工程应用，紧跟技术发展，掌握数字系统新的设计方法。n数字信号处理：面向工程信号处理应用的，由FPGA代替DSP来实现算法，提高系统的速度。课程宗旨n更新数字电路的设计观念，建立用PLD器件取代传统TTL器件设计数字电路的思想n更新数字系统设计手段，学会使用硬件描述语言（Hardware Description Language）代替传统的数字电路设计方法来设计数字系统。可编程逻辑器件的定义n逻辑器件：用来实现某种特定逻辑功能的电子
2、器件，最简单的逻辑器件是与、或、非门（74LS00，74LS04等），在此基础上可实现复杂的时序和组合逻辑功能。n可编程逻辑器件（PLDProgrammable Logic Device）：器件的功能不是固定不变的，而是可根据用户的需要而进行改变，即由编程的方法来确定器件的逻辑功能。课程内容n器件为什么能够编程n了解大规模可编程逻辑器件的结构及工作原理n怎样对器件编程n熟悉一种EDA软件的使用方法（工具）n以Altera公司的QuartusII为例n掌握一种硬件描述语言（方法），以设计软件的方式来设计硬件（重点）n以VHDL语言为例数字电路课程的回顾n布尔函数数字系统数学基础（卡诺图）n数字电
3、路设计的基本方法n组合电路设计问题逻辑关系真值表化简逻辑图n时序电路设计列出原始状态转移图和表状态优化状态分配触发器选型求解方程式逻辑图数字电路课程的回顾n使用中、小规模器件设计电路（74、54系列）n编码器（74LS138）n译码器（74LS154）n比较器（74LS85）n计数器（74LS193）n移位寄存器（74LS194）n数字电路课程的回顾n设计方法的局限n卡诺图只适用于输入比较少的函数的化简。n采用“搭积木”的方法进行设计。必须熟悉各种中小规模芯片的使用方法，从中挑选最合适的器件，缺乏灵活性。n设计系统所需要的芯片种类多，且数量很大。数字电路课程的回顾n采用中小规模器件的局限n电路
4、板面积很大，芯片数量很多，功耗很大，可靠性低提高芯片的集成度n设计比较困难能方便地发现设计错误n电路修改很麻烦提供方便的修改手段nPLD器件的出现改变了这一切PLD出现的背景n电路集成度不断提高nSSIMSILSIVLSIn计算机技术的发展使EDA技术得到广泛应用n设计方法的发展n自下而上自上而下n用户需要设计自己需要的专用电路n专用集成电路（ASICApplication Specific Integrated Circuits）开发周期长，投入大，风险大n可编程器件PLD：开发周期短，投入小，风险小数字电路课程的回顾数字电路课程的回顾数字电路课程的回顾数字电路课程的回顾PLD器件的优点n集
5、成度高，可以替代多至几千块通用IC芯片n极大减小电路的面积，降低功耗，提高可靠性n具有完善先进的开发工具n提供语言、图形等设计方法，十分灵活n通过仿真工具来验证设计的正确性n可以反复地擦除、编程，方便设计的修改和升级n灵活地定义管脚功能，减轻设计工作量，缩短系统开发时间n保密性好PLD的发展趋势n向高集成度、高速度方向进一步发展n最高集成度已达到400万门n向低电压和低功耗方向发展，5V3.3V2.5V1.8V更低n内嵌多种功能模块nRAM，ROM，FIFO，DSP，CPUn向数、模混合可编程方向发展PLD器件的分类按集成度n低密度nPROM,EPROM,EEPROM,PAL,PLA,GALn
6、只能完成较小规模的逻辑电路n高密度，已经有超过400万门的器件nEPLD,CPLD,FPGAn可用于设计大规模的数字系统,集成度高，甚至可以做到SOC（System On a Chip）PLD器件的分类按结构特点n基于与或阵列结构的器件阵列型nPROM，EEPROM，PAL，GAL，CPLDnCPLD的代表芯片如：Altera的MAX系列n基于门阵列结构的器件单元型nFPGAPLD器件的分类按编程工艺n熔丝或反熔丝编程器件Actel的FPGA器件n体积小，集成度高，速度高，易加密，抗干扰，耐高温n只能一次编程，在设计初期阶段不灵活nSRAM大多数公司的FPGA器件n可反复编程，实现系统功能的动
7、态重构n每次上电需重新下载，实际应用时需外挂EEPROM用于保存程序nEEPROM大多数CPLD器件n可反复编程n不用每次上电重新下载，但相对速度慢，功耗较大PLD的逻辑符号表示方法与门乘积项PROM结构n与阵列为全译码阵列，器件的规模将随着输入信号数量n的增加成2n指数级增长。因此PROM一般只用于数据存储器，不适于实现逻辑函数。nEPROM和EEPROM用用PROM实现组合逻辑电路功能实现组合逻辑电路功能实现的函数为：实现的函数为：固定连接点固定连接点（与）（与）编程连接点编程连接点（或）（或）PLA结构nPLA的内部结构在简单PLD中有最高的灵活性。PAL结构n与阵列可编程使输入项增多，
8、或阵列固定使器件简化。n或阵列固定明显影响了器件编程的灵活性AnBnCnAnBnCnAnBnCnAnBnCnAnBnAnCnBnCn用PAL实现全加器GAL结构nGAL器件与PAL器件的区别在于用可编程的输出逻辑宏单元（OLMC）代替固定的或阵列。可以实现时序电路。逻辑宏单元OLMCGAL器件的OLMCOutput Logic Macro Celln每个OLMC包含或阵列中的一个或门n组成：n异或门：控制输出信号的极性nD触发器：适合设计时序电路n4个多路选择器输出使能选择反馈信号选择或门控制选择输出选择CPLD内部结构（Altera的MAX7000S系列）逻辑阵列模块I/O单元连线资源逻辑阵
9、列模块中包含多个宏单元宏单元内部结构乘积项逻辑阵列乘积项选择矩阵可编程触发器可编程的I/O单元n能兼容TTL和CMOS多种接口和电压标准n可配置为输入、输出、双向、集电极开路和三态等形式n能提供适当的驱动电流n降低功耗，防止过冲和减少电源噪声n支持多种接口电压（降低功耗）n1.20.5um,5Vn0.35um,3.3Vn0.25um,internal 2.5V,I/O3.3Vn0.18um,internal 1.8V,I/O2.5V and 3.3V可编程连线阵列n在各个逻辑宏单元之间以及逻辑宏单元与I/O单元之间提供信号连接的网络nCPLD中一般采用固定长度的线段来进行连接，因此信号传输的延
10、时是固定的，使得时间性能容易预测。FPGA结构原理图n内部结构称为LCA（Logic Cell Array）由三个部分组成：n可编程逻辑块（CLB）n可编程输入输出模块（IOB）n可编程内部连线（PIC）IOBCLB包含多个逻辑单元PICLE内部结构查找表的基本原理N个输入的逻辑函数需要2的N次方的容量的SRAM来实现，一般多个输入的查找表采用多个逻辑块级连的方式查找表的基本原理N个输入的逻辑函数需要2的N次方的容量的SRAM来实现，一般多于输入的查找表采用多个逻辑块级连的方式FPGA中的嵌入式阵列（EAB）n可灵活配置的RAM块n用途n实现比较复杂的函数的查找表，如正弦、余弦等。n可实现多种
11、存储器功能，如RAM，ROM，双口RAM，FIFO，Stack等n灵活配置方法：2568，也可配成5124内部晶体震荡器n高速反向放大器用于和外部晶体相接，形成内部晶体振荡器。n提供将振荡波形二分频成对称方波的功能。CPLD与FPGA的区别CPLDFPGA程序存储 内部EEPROMSRAM，外挂EEPROM资源类型 组合电路资源丰富触发器资源丰富集成度低高使用场合 完成控制逻辑能完成比较复杂的算法速度慢快其他资源EAB，锁相环保密性可加密一般不能保密FPGA与CPLD的区别nFPGA采用SRAM进行功能配置，可重复编程，但系统掉电后，SRAM中的数据丢失。因此，需在FPGA外加EPROM，将配
12、置数据写入其中，系统每次上电自动将数据引入SRAM中。CPLD器件一般采用EEPROM存储技术，可重复编程，并且系统掉电后，EEPROM中的数据不会丢失，适于数据的保密。FPGA与CPLD的区别nFPGA器件含有丰富的触发器资源，易于实现时序逻辑，如果要求实现较复杂的组合电路则需要几个CLB结合起来实现。CPLD的与或阵列结构，使其适于实现大规模的组合功能，但触发器资源相对较少。FPGA与CPLD的区别nFPGA为细粒度结构，CPLD为粗粒度结构。FPGA内部有丰富连线资源，CLB分块较小，芯片的利用率较高。CPLD的宏单元的与或阵列较大，通常不能完全被应用，且宏单元之间主要通过高速数据通道连
13、接，其容量有限，限制了器件的灵活布线，因此CPLD利用率较FPGA器件低。FPGA与CPLD的区别nFPGA为非连续式布线，CPLD为连续式布线。FPGA器件在每次编程时实现的逻辑功能一样，但走的路线不同，因此延时不易控制，要求开发软件允许工程师对关键的路线给予限制。CPLD每次布线路径一样，CPLD的连续式互连结构利用具有同样长度的一些金属线实现逻辑单元之间的互连。连续式互连结构消除了分段式互连结构在定时上的差异，并在逻辑单元之间提供快速且具有固定延时的通路。CPLD的延时较小。PLD器件的命名与选型nEPM7 128 S L C 8410nEPM7：产品系列为EPM7000系列n128：有
14、128个逻辑宏单元nS：电压为5V，AE为3.3V，B为2.5VnL：封装为PLCC，Q代表PQFP等nC：商业级（Commercial）070度，I：工业级（Industry），4085度M：军品级（Military），55125度n84：管脚数目n10：速度级别管脚的定义n特殊功能的管脚n电源脚VCC和GND，VCC一般分为VCCINT和VCCIO两种nJTAG管脚：实现在线编程和边界扫描n配置管脚（FPGA）：用于由EEPROM配置芯片n信号管脚n专用输入管脚：全局时钟、复位、置位n可随意配置其功能为：输入、输出、双向、三态PLD的设计步骤设计输入n原理图输入n使用元件符号和连线等描述n
15、比较直观，但设计大规模的数字系统时则显得繁琐nHDL语言输入n逻辑描述功能强n成为国际标准，便于移植n原理图与HDL的联系与高级语言与汇编语言类似设计处理n综合和优化n优化：将逻辑化简，去除冗余项，减少设计所耗用的资源n综合：将模块化层次化设计的多个文件合并为一个网表，使设计层次平面化n映射n把设计分为多个适合特定器件内部逻辑资源实现的逻辑小块的形式n布局与布线n将已分割的逻辑小块放到器件内部逻辑资源的具体位置并利用布线资源完成各功能块之间的连接n生成编程文件n生成可供器件编程使用的数据文件模拟仿真n功能仿真n不考虑信号传输和器件的延时n时序仿真n不同器件的内部延时不一样，不同的布局、布线延时
16、也会有比较大的不同n在线验证n利用实现手段测试器件最终功能和性能指标在系统编程技术ISPIn System Programn对PLD的逻辑功能可随时进行修改。由Lattice公司率先发明n优点：n方便硬件的调试n方便硬件版本的升级，类似于软件升级在系统编程技术ISPIn System Program边界扫描测试技术BSTBoundary Scan Testn据IEEE1149.1标准JTAG，用于解决大规模集成电路的测试问题。n现在新开发的可编程器件都支持边界扫描技术，并将其作为ISP接口。n在DSP开发和嵌入式处理器的开发中应用得非常广泛。基本组合逻辑基本组合逻辑与运算与运算 或运算或运算
17、异或运算异或运算 与非运算与非运算 2 2选选1 1多路选择器多路选择器 两位比较器两位比较器 基本时序器件基本时序器件D D触发器触发器 T T触发器触发器 J-KJ-K触发器触发器 时序器件时序器件移位寄存器移位寄存器 基本简单数学运算基本简单数学运算 加法器加法器 计数器计数器 n逐位进位加法器逐位进位加法器n超前进位加法器超前进位加法器n进位选择加法器进位选择加法器n逐位进位计数器逐位进位计数器n格雷码逐位计数器格雷码逐位计数器n流水式超前进位计数器流水式超前进位计数器 乘法器乘法器 n组合逻辑实现的乘法器组合逻辑实现的乘法器n移位相加乘法器移位相加乘法器n查找表乘法器查找表乘法器n加法器树乘法器加法器树乘法器