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1、锁存器和触发器原理锁存器和触发器原理1第1页，本讲稿共34页本章学习基本要求本章学习基本要求1、掌握锁存器、触发器的电路结构和工作原理；、掌握锁存器、触发器的电路结构和工作原理；2、熟练掌握、熟练掌握SR触发器、触发器、JK触发器、触发器、D触发器及触发器及T 触触发器的逻辑功能；发器的逻辑功能；3、正确理解锁存器、触发器的动态特性。、正确理解锁存器、触发器的动态特性。2第2页，本讲稿共34页 时序逻辑电路时序逻辑电路:锁存器和触发器锁存器和触发器是构成时序逻辑电路的基本逻辑单元是构成时序逻辑电路的基本逻辑单元 。结构特征结构特征:由组合逻辑电路和由组合逻辑电路和存储电路存储电路组成组成,电路
2、中存在反馈。电路中存在反馈。工作特征：工作特征：时序逻辑电路的工作特点是时序逻辑电路的工作特点是任意时刻的输出状态不仅与当任意时刻的输出状态不仅与当前的输入信号有关，而且与此前电路的状态有关。前的输入信号有关，而且与此前电路的状态有关。3第3页，本讲稿共34页反馈5.1.2 双稳态存储单元电路 Q端的状态定义为电路输出状态。端的状态定义为电路输出状态。电路有两个互补的输出端电路有两个互补的输出端1.电路结构电路结构 4第4页，本讲稿共34页2、数字逻辑分析电路具有电路具有记忆记忆1 1位二进制数据的功能位二进制数据的功能。如如 Q=1如如 Q=0100101105第5页，本讲稿共34页5.2.
3、1 SR 锁存器5.2 锁存器5.2.1 D 锁存器6第6页，本讲稿共34页5.2.1 SR 锁存器5.2 锁存器1.基本SR锁存器初态初态：R、S信号作用前信号作用前Q端的状端的状态，态，用用Q n表示。表示。次态次态：R、S信号作用后信号作用后Q端的端的状态状态，用用Q n+1表示。表示。7第7页，本讲稿共34页8第8页，本讲稿共34页1)工作原理R=0、S=0状态不变状态不变00若初态 Q n=1101若初态 Q n=0010009第9页，本讲稿共34页无论初态无论初态Q n为为0或或1，锁存器的次态为为，锁存器的次态为为1态。态。信号消失后新信号消失后新的状态将被记忆下来。的状态将被记
4、忆下来。01若初态 Q n=1101若初态 Q n=0010010R=0、S=1置置110第10页，本讲稿共34页无论初态无论初态Q n为为0或或1，锁存器的次态为，锁存器的次态为0态。态。信号消失后新的状信号消失后新的状态将被记忆下来。态将被记忆下来。10若初态 Q n=1110若初态 Q n=0100101R=1、S=0置置011第11页，本讲稿共34页1100S=1、R=1无论初态Q n为0或1，触发器的次态 、都为0 。状态不确定状态不确定约束条件约束条件:SR=:SR=0 0当当S、R 同时回到同时回到0时，由于两个与非门的时，由于两个与非门的延迟时间无法确定，使得锁存器最终稳定状延
5、迟时间无法确定，使得锁存器最终稳定状态也不能确定。态也不能确定。触发器的输出既不是触发器的输出既不是0态，也不是态，也不是1态态12第12页，本讲稿共34页3）工作波形13第13页，本讲稿共34页反馈输入端输入端输出端输出端由两个与非门组成由两个与非门组成1.电路结构与逻辑符号 锁存器由逻辑门加反馈电路构成，电路有两个互补的 输出端Q和 ,其中Q的状态称为锁存器的状态。用与非门构成的基本SR锁存器国标逻辑符号14第14页，本讲稿共34页 2、工作原理1)无有效电平输入（无有效电平输入（S=R=1）时，锁存器保持稳定状态不变）时，锁存器保持稳定状态不变 1 11 1若初态若初态Qn=1若初态若初
6、态 Qn=01 10 01 10 01 10 01 11 115第15页，本讲稿共34页 2)在有效电平作用下（在有效电平作用下（S=0、R=1），无论初态，无论初态Q n为为0或或1，锁存器，锁存器都会转变为都会转变为1态。态。0 01 1若初态若初态Qn=1若初态若初态Q Qn n=0=01 10 01 10 01 10 01 11 10 0 这种情况称将锁存器这种情况称将锁存器这种情况称将锁存器这种情况称将锁存器置置置置1 1 1 1或置位或置位或置位或置位。S S S S端端端端称为锁存器的称为锁存器的称为锁存器的称为锁存器的置置置置1 1 1 1端或置位端端或置位端端或置位端端或置位
7、端。16第16页，本讲稿共34页 3)在有效电平作用下（在有效电平作用下（S=1、R=0），无论初态），无论初态Q n为为0或或1，锁存器，锁存器都会转变为都会转变为0态。态。1 10 0初态初态Qn=xx x1 10 0 这种情况称将锁存器这种情况称将锁存器这种情况称将锁存器这种情况称将锁存器置置置置0 0 0 0或复位或复位或复位或复位。R R R R端端端端称为锁存器的称为锁存器的称为锁存器的称为锁存器的置置置置0 0 0 0端或复位端端或复位端端或复位端端或复位端。17第17页，本讲稿共34页 4)4)当（当（S=0S=0、R=0 R=0）时，无论初态）时，无论初态Q Q n n为为0
8、 0或或1 1，锁存器状态不定。，锁存器状态不定。0 00 0初态初态Qn=x1 11 1 R=0R=0、S=0S=0时：时：Q=Q=1Q=Q=1，不符合锁存器的，不符合锁存器的逻辑关系。并且由于与非门延迟时间不可逻辑关系。并且由于与非门延迟时间不可能完全相等，在两输入端的能完全相等，在两输入端的0 0同时撤除后，同时撤除后，将不能确定锁存器是处于将不能确定锁存器是处于1 1状态还是状态还是0 0状态。状态。所以锁存所以锁存不允许出现这种情况不允许出现这种情况不允许出现这种情况不允许出现这种情况，这就是基这就是基本本RSRS锁存器的锁存器的约束条件约束条件约束条件约束条件。此状态为不定状此状态
9、为不定状态。为避免不定状态，对输入信号应加态。为避免不定状态，对输入信号应加S S+R R=1=1的约束条件的约束条件。18第18页，本讲稿共34页3、触发方式0 11 01 0置1端置0端基本锁存器的触发方式属基本锁存器的触发方式属电平电平触发。触发。19第19页，本讲稿共34页S R 1 1 0 0 1 1 1 1 0 1 0 1 0 1 1 1 1 0 0 0 1 0 1 0 0 0 0 不定 0 0 1 不定 4、逻辑功能逻辑功能表逻辑功能表R+S=1保持保持置置1 1置零置零不定不定 锁存器的新状态锁存器的新状态Q Qn+1n+1（也称次态）不仅与（也称次态）不仅与输入状态输入状态有
10、关，也与锁有关，也与锁存器存器原来原来的状态的状态Q Qn n（也称现态或初态）有关。（也称现态或初态）有关。20第20页，本讲稿共34页画工作波形的方法画工作波形的方法(与非门锁存器）：与非门锁存器）：1.根据锁存器动作特征确定状态变化的时刻；根据锁存器动作特征确定状态变化的时刻；2.根据触发器的逻辑功能确定根据触发器的逻辑功能确定Qn+1。0 01 11 11 10 01 11 11 10 01 11 11 10 01 11 11 10 00 0不不定定 不变不变 不定不定 置置1 1 不变不变 置置1 1 不变不变 置置0 0 不变不变 工作波形能直观地表示其输入信号与输出的时序关系。工
11、作波形能直观地表示其输入信号与输出的时序关系。21第21页，本讲稿共34页 例2 运用基本SR锁存器消除机械开关触点抖动引起的脉冲输出。22第22页，本讲稿共34页硬件设计硬件设计去抖动电路去抖动电路23第23页，本讲稿共34页2.逻辑门控SR锁存器 电路结构 国标逻辑符号简单SR锁存器使能信号控制门电路锁存使能输入端24第24页，本讲稿共34页2、工作原理 S=0，R=0：Qn+1=Qn S=1，R=0：Qn+1=1 S=0，R=1：Qn+1=0 S=1，R=1：Qn+1=E=1：E=0：状态发生变化。状态发生变化。状态不变状态不变Q3=S Q4=R锁存使能输入端25第25页，本讲稿共34页
12、例3 逻辑门控SR锁存器的E、S、R 的波形如下图所示，锁存器的原始状态为Q=0，26第26页，本讲稿共34页5.2.2 D 锁存器1.逻辑门控D锁存器国标逻辑符号国标逻辑符号逻辑电路图逻辑电路图27第27页，本讲稿共34页=SS=0 R=1D=0Q=0D=1Q=1E=0不变E=1=DS=1 R=0D锁存器的功能表锁存器的功能表置10111置01001保持不变不变0功能QDEQ逻辑功能28第28页，本讲稿共34页2.传输门控D锁存器 (c)E=0时时(b)E=1时时(a)电路结构电路结构TG2导通，导通，TG1断开断开 TG1导通，导通，TG2断开断开Q=DQ 不变不变29第29页，本讲稿共3
13、4页例4 工作波形30第30页，本讲稿共34页3.D锁存器的动态特性定时图定时图:表示电路动作过程中，对各输入信号的表示电路动作过程中，对各输入信号的时间要求以及输出对输入信号的响应时间。时间要求以及输出对输入信号的响应时间。31第31页，本讲稿共34页74HC/HCT373 八D锁存器4.典型集成电路32第32页，本讲稿共34页74HC/HCT373的功能表工作模式输 入内部锁存器状 态输 出LEDnQn使能和读锁存器（传送模式）LHLLLLHHHH锁存和读锁存器LLL*LLLLH*HH锁存和禁止输出H高阻H高阻L*和和H*表示门控电平表示门控电平LE由高变低之前瞬间由高变低之前瞬间Dn的逻辑电平。的逻辑电平。33第33页，本讲稿共34页作业题作业题o238238页：页：5.2.45.2.4，5.2.55.2.5 34第34页，本讲稿共34页