2022年北京邮电大学计算机组成原理自测试题库_试卷六 .pdf

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1、本科生期末试卷(六)一、选择题(每小题2 分,共 30 分)1从器件角度看,计算机经历了五代变化。但从系统结构看,至今绝大多数计算机仍属于()计算机。 A 并行 B 冯诺依曼 C 智能 D 串行2某机字长 32 位,其中 1 位表示符号位。若用定点整数表示,则最小负整数为()。 A -(231-1) B -(230-1) C -(231+1) D -(230+1) 3以下有关运算器的描述,()是正确的。 A 只做加法运算 B 只做算术运算 C 算术运算与逻辑运算 D 只做逻辑运算4 EEPROM 是指()。 A 读写存储器 B 只读存储器 C 闪速存储器 D 电擦除可编程只读存储器5常用的虚拟

2、存储系统由()两级存储器组成,其中辅存是大容量的磁表面存储器。 A cache-主存 B 主存-辅存 C cache-辅存 D 通用寄存器 -cache 6 RISC 访内指令中,操作数的物理位置一般安排在()。A 栈顶和次栈顶 B 两个主存单元C 一个主存单元和一个通用寄存器 D 两个通用寄存器7当前的 CPU 由()组成。A 控制器 B 控制器、运算器、 cache C 运算器、主存 D 控制器、 ALU 、主存8流水 CPU 是由一系列叫做“段”的处理部件组成。和具备 m个并行部件的 CPU 相比,一个 m段流水 CPU的吞吐能力是()。A 具备同等水平名师资料总结 - - -精品资料欢

3、迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 3 页 - - - - - - - - - B 不具备同等水平C 小于前者 D 大于前者9在集中式总线仲裁中,()方式响应时间最快。 A 独立请求 B 计数器定时查询 C 菊花链10 CPU 中跟踪指令后继地址的寄存器是()。 A 地址寄存器 B 指令计数器 C 程序计数器 D 指令寄存器11从信息流的传输速度来看,()系统工作效率最低。 A 单总线 B 双总线 C 三总线 D 多总线12单级中断系统中, CPU 一旦响应中断,立即关闭()标志,以防止本次中

4、断服务结束前同级的其他中断源产生另一次中断进行干扰。 A 中断允许 B 中断请求 C 中断屏蔽 D DMA请求13安腾处理机的典型指令格式为()位。 A 32位 B 64位 C 41位 D 48位14下面操作中应该由特权指令完成的是()。A 设置定时器的初值B 从用户模式切换到管理员模式C 开定时器中断 D 关中断15下列各项中,不属于安腾体系结构基本特征的是()。 A 超长指令字 B 显式并行指令计算 C 推断执行 D 超线程二、简答题(每小题8 分,共 16分)1简要总结一下,采用哪几种技术手段可以加快存储系统的访问速度?2一台机器的基本指令系统有哪几类典型指令?列出其名称。三、证明题(

5、12 分)求证: -y补=-y补 (mod 2n+1) 四、设计题( 14 分)名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页,共 3 页 - - - - - - - - - 现给定与门、或门、异或门三种芯片,其中与门、或门的延迟时间为20ms ,异或门的延迟时间为60ns。(1) 请写出一位全加器( FA )的真值表和逻辑表达式,画出FA的逻辑图。(2) 画出 32位行波进位加法器 / 减法器的逻辑图。注:画出最低2 位和最高 2 位(含溢出电路)(3) 计算一次加法所用的

6、总时间。五、计算题( 12 分)某计算机的存储系统由cache、主存和磁盘构成。 cache 的访问时间为 15ns;如果被访问的单元在主存中但不在 cache 中,需要用 60ns 的时间将其装入cache,然后再进行访问;如果被访问的单元不在主存中,则需要 10ms的时间将其从磁盘中读入主存,然后再装入 cache 中并开始访问。 若 cache 的命中率为 90% ,主存的命中率为 60% ,求该系统中访问一个字的平均时间。六、设计题( 16 分)图 1 所示为双总线结构机器的数据通路,IR 为指令寄存器, PC 为程序计数器(具有自增功能) ,DM 为数据存储器(受/R W信号控制),

7、AR 为地址寄存器, DR 为数据缓冲寄存器, ALU 由加、减控制信号决定完成何种操作,控制信号G 控制的是一个门电路。另外,线上标注有小圈表示有控制信号,例中yi表示 y 寄存器的输入控制信号, R1o为寄存器 R1的输出控制信号,未标字符的线为直通线,不受控制。旁路器可视为三态门传送通路。图 1 “SUB R3,R0”指令完成030()()RRR 的功能操作,画出其指令周期流程图,并列出相应的微操作控制信号序列,假设该指令的地址已放入PC 中。若将“取指周期” 缩短为一个 CPU 周期,请在图上先画出改进的数据通路,然后在画出指令周期流程图。此时 SUB 指令的指令周期是几个CPU 周期?与第种情况相比,减法指令速度提高几倍?名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页,共 3 页 - - - - - - - - -

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