《EDA技术基础》复习资料.doc

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1、EDA复习资料EDA技术基础题库及参考答案（试用版）目 录一、填空题1二、单选题5三、简答题10四、应用题11五、上机实验题15I ; ; 低低输;( 高- :0 数载） 由-; 检检钟 变义 ) _ 构构 端输- _ 端端行 - : 能使数并有钟- 存移 - 用-; 存位移位置并同; 输口数- ; ( 于测检计允 : 能使同许是检 升升检 步异-; (= 变义 ) _ _ 进- , ( 构结 0 出进 ) : ) _ ; _ ( 0 . _ _ 用调 器计制的钟同复有个; 的实射 的层- ,= ( ) = = 语例-; , = : 线接部号个义- _ ) ; : ( ) , 语声半- 构-

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6、 =) , -射的 有的器 _ ) 进 结 ( - _ 义 - 许能 检于 (大， ; = 输 口 并位 - -存 -钟数 : - _-端 构 钟 -由载 高 (低 ; I一、填空题1 现代电子技术经历了 CAD 、 CAE 和 EDA 三个主要的发展阶段。2 EDA技术包括 大规模可编程器件 、 硬件描述语言HDL 、 EDA工具软件 和 实验开发系统 四大要素。3 EDA的设计输入主要包括 文本输入方式 、 图形输入方式 和 波形输入方式 三种形式。4 目前已经成为IEEE标准、应用最为广泛的硬件描述语言有 VHDL 和 Verilog HDL 。仿真是一种对所设计电路进行间接检测的方法，

7、包括_ 功能 仿真和_ 时序 仿真。5 层次化设计是将一个大的设计项目分解为若干个子项目或若干个层次来完成的。先从底层的电路设计开始，然后在_高层次_的设计中逐级调用 低层次 的设计结果，直至实现系统电路的设计。6 用HDL设计的电路，既可以被高层次的系统调用，成为系统的一部分，也可以作为一个电路的功能块 独立存在 和 独立运行_。7 可编程逻辑器件从结构上可分为乘积项结构器件 和查找表结构器件 。8 PLD（FPGA、CLPD）种类繁多，特点各异。共同之处包括的三大部分是逻辑块阵列、输入/输出块和互连资源。9 FPGA两类配置下载方式是主动配置方式 和被动配置方式 。10 Quartus I

8、I是EDA器件制造商ltera公司自己开发的_EDA工具_软件。11 Quartus II工具软件安装成功后、第一次运行前，还必 授权 。12 Quartus II支持 原理图 、_文本 和 波形 等不同的编辑方式。13 在Quartus II集成环境下，设计文件不能直接保存在计算机磁盘根目录中，因此设计者在进入设计之前，应当在磁盘根目录中建立保存设计文件的 工程目录（文件夹） 。14 在Quartus II集成环境下执行原理图输入设计法，应选择_模块/原理图文件(Block Diagram/Schematic File )._方法，设计文件的扩展名是_ .bdf_。15 无论何种设计环境，V

9、HDL设计文件都_ .vhd_的扩展名保存，而Verilog HDL设计文件应以_ .v_的扩展名保存。16 设计文件输入结束后一定要通过 编译（Compiler） ，检查设计文件是否正确。17 在Quartus II集成环境下可以执行 Create Default Symbol 命令，为设计文件创建一个元件符号。这个元件符号的扩展名为 .bsf_，它可以被其他图形设计文件 调用 ，以实现多层次的系统电路设计。18 指定设计电路的输入输出端口与目标芯片引脚的连接关系的过程称为_引脚锁定_。19 Quartus II中波形文件的扩展名是_ .vwf_。20 在完成设计电路的输入输出端口与目标芯片

10、引脚的锁定后，再次对设计电路的仿真称为_时序仿真_或_后仿真_。21 以EDA方式实现的电路设计文件，最终可以编程下载到_ FPGA_ _或_ CPLD _芯片中，完成硬件设计和验证。22 在对设计文件编程下载时，需要选择的ByteBlaster(MV)编程方式，此编程方式对应计算机的 _并行口 编程下载通道，“MV”是 混合电压 的意思。23 一般将一个完整的VHDL程序称为 设计实体 。24 VHDL设计实体由 库和程序包 、 实体 、 结构体 、和 配置 等部分构成。其中 _实体 和 结构体 是设计实体的基本组成部分，它们可以构成最基本的VHDL程序。25 VHDL的设计实体由 实体声明

11、 部分和 结构体 组成。26 VHDL的实体声明部分指定了设计单元的 输入/输出端口 或 引脚 ，它是设计实体对外的一个通信界面，是外界可以看到的部分；VHDL的结构体用来描述设计实体的 逻辑结构 和 _逻辑功能 ，它由VHDL语句构成，是外界看不到的部分。27 VHDL的普通标识符（或称“短标识符”）必须以 字母开头 ，后跟若干字母、数字或单个下划线构成，且不能以 下划线 结束。 28 在VHDL中最常用的库是 IEEE 标准库，最常用的程序包是_ （STD_LOGIC_1164）_。29 在VHDL的端口声明语句中，端口方向关键字包括_ IN _、_OUT _、_INOUT _和 _BUF

12、FER 。30 在VHDL程序中，单个字符要用 单引号 括起来，字符串要用 双引号 括起来。31 VHDL的数据对象包括 变量 、 常量 和 信号 ，它们是用来存放各种类型数据的容器。32 常数是程序中 恒定不变 的值，一般在 程序前部 声明，在VHDL中用 CONSTANT_ 语句定义。33 VHDL的变量(VARIABLE)是一个 局部量 ，只能在进程、函数和过程中声明和使用。34 VHDL的信号(SIGNAL)是一种数值容器，不仅可以容纳 当前值 ，也可以保持 历史值 。35 VHDL的操作符包括_逻辑操作符_（Logic Operator）_、_关系操作符（Relational Ope

13、rator）_、_算术操作符（Arithmetic Operator）_和_ 符号操作符（Sign Operator） 。36 在VHDL中，预定义的 属性标识符 可用于检出时钟边沿、完成定时检查、获得未约束的数据类型的范围等。37 HDL的基本描述语句包括_ 顺序语句（Sequential Statements）_和 并行语句（Concurrent Statements）_。38 VHDL的顺序语句只能出现在 进程（PROCESS） 、 过程_(PROCEDURE)_和 函数(FUNCTION)_中，是按程序书写的顺序自上而下、一条一条地执行。39 VHDL的PROCESS语句是由 顺序语句

14、 组成的，但其本身却是 并行语句 。40 VHDL的并行信号赋值语句的赋值目标必须都是_信号_。41 VHDL的子程序有_过程（PROCEDURE）_和_函数(FUNCTION)_两种类型。42 元件例化是将预先设计好的设计实体或设计模块作为一个_元件_，连接到当前设计实体或设计模块中一个指定的_端口_。43 VHDL的程序包是用VHDL语言编写的，其源程序也需要以_vhd_文件类型保存。44 元件例化时端口映射方式分为_位置_映射法、_ 名称_映射法和_ 混合_映射法3种。45 注释VHDL设计实体：LIBRARY IEEE；USE IEEE.STD_LOGIC_1164.ALL； - 库、

15、程序包 声明ENTITY H_ADDER ISPORT(A，B：IN STD_LOGIC；SO ，CO：OUT STD_LOGIC)； - 实体 声明END ENTITY H_ADDER； ARCHITECTURE ART2 OF H_ADDER IS - 结构体 声明BEGINSO=(A OR B) AND (A NAND B)； CO=NOT (A NAND B)；END ARCHITECTURE ART2；46 在Quartus II环境下，要通过执行File菜单下的 Create Update / Create Symbol Files for Current File 命令产生元件符

16、号。47 按结构特点和编程工艺的不同，大规模、高密度PLD器件可分为 CPLD 和 FPGA 两大类。48 采用SRAM结构的可编程器件，在系统断电后编程信息 不保存（消失） 。49 在世界上为数众多的EDA生产厂商中最大的三家是 ALTERA 、_ XILINX _和 _Lattice 。17二、单选题1 关于EDA技术的设计流程，下列顺序正确的是 ( A )A 原理图/HDL文本输入功能仿真综合适配编程下载硬件测试B 原理图/HDL文本输入适配综合功能仿真编程下载硬件测试；C 原理图/HDL文本输入功能仿真综合编程下载适配硬件测试；D 原理图/HDL文本输入功能仿真适配编程下载综合硬件测试

17、2 对利用原理图输入设计方法进行数字电路系统设计，下面说法是不正确的（C）A 原理图输入设计方法直观便捷，但不适合完成较大规模的电路系统设计；B 原理图输入设计方法一般是一种自底向上的设计方法；C 原理图输入设计方法无法对电路进行功能描述；D 原理图输入设计方法也可进行层次化设计。3 下列对CPLD结构与工作原理的描述中，正确的是（C）A CPLD是基于查找表结构的可编程逻辑器件；B CPLD即是现场可编程逻辑器件的英文简称；C 早期的CPLD是从GAL的结构扩展而来；D 在Altera公司生产的器件中，MAX7000系列属CPLD结构；4 Quartus II的设计文件不能直接保存在（ B

18、）。A 系统默认路径 B 硬盘根目录 C 项目文件夹 D 用户自定义工程目录5 执行Quartus II的（ A ）命令，可以为设计电路建立一个元件符号。A Create Update / Create Symbol Files for Current File B Simulator C Compiler D Timing Analyzer6 在下列器件中，不属于PLD的器件是（C ）。A PROM B PAL C SRAM D PLA7 在PLD中陈列图如下所示，其逻辑表达式为（B）F=A+B+CF=A+CF=ACF=ABCD8 使用Quartus II工具软件建立仿真文件，应采用（D）方

19、式图形编辑文本编辑符号编辑波形编辑9 建立设计项目的菜单是（C）“File”“New ”“Project”“New Project Wizard”“File”“New Project Wizard”10 在plus工具软件中，包括门电路、触发器、电源、输入、输出等元件的元件库是（C）文件夹maxplus2max2libmf Bquartuslibrarymega_lpmCquartuslibraryprimitives Dmyedamygdf11 在Quartus II工具软件中，完成编译网表提取、数据库建立、逻辑综合、逻辑分割、适配、延时网表提取和编程文件汇编等打操作，并检查设计文件是否正确

20、的过程称为（B）编辑编译综合编程12 在Quartus II集成环境下为图形文件产生一个元件符号的主要用途是（D）仿真编译综合被高层次电路设计调用13 仿真是对电路设计的一种（B）检测方法直接的间接的同步的异步的14 执行Quartus II的（B）命令，可以对设计电路进行功能仿真或者时序仿真Create Default Symbol BStart SimulationCompiler DTiming Analyzer 15 Quartus II的波形文件类型是（A） . vwf . gdf . vhd . v16 Quartus II的图形设计文件类型是（B） . scf . bdf . vhd . v17 Quartus II是（C）高级语言硬件描述语言EDA工具软件综合软件18 使用Quartus II工具软件实现原理图设计输入，应采用（A）方式模块/原理图文件文本编辑符号编辑波形编辑19 使用Quartus II的图形编