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1、关于嵌入式硬件基础第一张，PPT共八十三页，创作于2022年6月嵌入式系统嵌入式系统硬件部分嵌入式系统软件部分如人的大脑，决定了硬件的操作模式。通过良好的操作系统以及应用程序，把硬件功能发挥到极至。如人的手、脚、神经等部位，决定了嵌入式系统的先天功能。如运算能力和I/O接口等。第二张，PPT共八十三页，创作于2022年6月主要内容1 13 32 24 4基本组成嵌入式处理器总线存储器第三张，PPT共八十三页，创作于2022年6月n嵌入式微处理器n总线n存储器n输入/输出接口和设备嵌入式系统硬件组成第四张，PPT共八十三页，创作于2022年6月嵌入式微处理器指令系统CISCCISC：复杂指令集（
2、：复杂指令集（Complex Instruction Set ComputerComplex Instruction Set Computer）具有大量的指令和寻址方式，指令长度可变具有大量的指令和寻址方式，指令长度可变8/28/2原则：原则：80%80%的程序只使用的程序只使用20%20%的指令的指令大多数程序只使用少量的指令就能够运行。大多数程序只使用少量的指令就能够运行。RISCRISC：精简指令集（：精简指令集（Reduced Instruction Set Computer)Reduced Instruction Set Computer)只包含最有用的指令，指令长度固定只包含最有用
3、的指令，指令长度固定确保数据通道快速执行每一条指令确保数据通道快速执行每一条指令使使CPUCPU硬件结构设计变得更为简单硬件结构设计变得更为简单第五张，PPT共八十三页，创作于2022年6月CISC与RISC的对比类别CISCRISC指令系统指令数量很多，通常200较少，通常少于100执行时间有些指令执行时间很长，如整块的存储器内容拷贝；或将多个寄存器的内容拷贝到存贮器没有较长执行时间的指令编码长度编码长度可变，1-15字节编码长度固定，通常为4个字节寻址方式寻址方式多样简单寻址操作可以对存储器和寄存器进行算术和逻辑操作只能对寄存器进行算术和逻辑操作，Load/Store体系结构编译难以用优化
4、编译器生成高效的目标代码程序 采用优化编译技术，生成高效的目标代码程序 第六张，PPT共八十三页，创作于2022年6月冯诺依曼体系结构嵌入式微处理器指令系统第七张，PPT共八十三页，创作于2022年6月冯诺依曼体系结构指令寄存器控制器算逻单元输入输出中央处理器存储器程序指令0指令1指令2指令3指令4数据数据0数据1数据2第八张，PPT共八十三页，创作于2022年6月哈佛体系结构指令寄存器控制器算逻单元输入输出CPU程序存储器指令0指令1指令2数据存储器数据0数据1数据2地址指令地址数据第九张，PPT共八十三页，创作于2022年6月Motorola公司DSP56311结构哈佛结构第十张，PPT共
5、八十三页，创作于2022年6月总线n嵌入式系统的总线一般集成在嵌入式微处理器中。n从微处理器的角度来看，总线可分为片外总线和片内总线。n选择总线和选择嵌入式微处理器密切相关，总线的种类随不同的微处理器的结构而不同。第十一张，PPT共八十三页，创作于2022年6月存储器n嵌入式系统的存储器包括cache、主存和外存。n大多数嵌入式系统的代码和数据都存储在处理器可直接访问的存储空间即主存中。系统上电后在主存中的代码直接运行。n外存是处理器不能直接访问的存储器，用来存放各种信息。第十二张，PPT共八十三页，创作于2022年6月存储器寄存器高速缓存SRAM主存储器SDRAM本地存储器Flash、ROM
6、、磁盘网络存储器Flash、ROM、磁盘时钟周期01101010020,000,000分层结构第十三张，PPT共八十三页，创作于2022年6月主要内容1 13 32 24 4基本组成嵌入式处理器总线存储器第十四张，PPT共八十三页，创作于2022年6月嵌入式微处理器的分类n嵌入式微处理器种类繁多，按位数可分为4位、8位、16位、32位和64位。n按用途来分，嵌入式微处理器可分为嵌入式DSP和通用的嵌入式微处理器两种：n嵌入式DSP：专用于数字信号处理，采用哈佛结构，程序和数据分开存储，采用一系列措施保证数字信号的处理速度。n通通用用的的嵌嵌入入式式微微处处理理器器：一般是集成了通用微处理器的核
7、、总线、外围接口和设备的SOC芯片，有些还将DSP作为协处理器集成。第十五张，PPT共八十三页，创作于2022年6月嵌入式微处理器的特点n集成度n体系结构n指令集n性能n功耗和管理第十六张，PPT共八十三页，创作于2022年6月嵌入式微处理器的集成度嵌入式微处理器是面向应用的，其片内所包含的组件的数目和种类是由它的市场定位决定的。在最普通的情况下，嵌入式微处理器包括：n片内存储器：部分嵌入式微处理器n外部存储器的控制器，外设接口(串口，并口)nLCD控制器：面向终端类应用的嵌入式微处理器n中断控制器，DMA控制器，协处理器n定时器，A/D、D/A转换器n多媒体加速器：当高级图形功能需要时n总线
8、n其他标准接口或外设第十七张，PPT共八十三页，创作于2022年6月嵌入式微处理器的集成度单芯片方式：三星单芯片方式：三星44B0X芯片的内部结构芯片的内部结构 单芯片方式第十八张，PPT共八十三页，创作于2022年6月嵌入式微处理器的集成度芯片组方式：两芯片组的手持芯片组方式：两芯片组的手持PC方案方案 芯片组方式第十九张，PPT共八十三页，创作于2022年6月嵌入式微处理器的体系结构n算术格式（ArithmeticFormat）n功能单元（FunctionalUnits）n流水线（Pipeline）n通常采用单周期执行指令，可能导致比较长的流水线第二十张，PPT共八十三页，创作于2022年
9、6月流水线技术流水线流水线(Pipeline)(Pipeline)技术：几个指令可以并行执行技术：几个指令可以并行执行n 提高了提高了CPUCPU的运行效率的运行效率n 内部信息流要求通畅流动内部信息流要求通畅流动译码取指执行add译码取指执行sub译码取指执行cmp时间AddSubCmp第二十一张，PPT共八十三页，创作于2022年6月指令流水线以ARM为例n为增加处理器指令流的速度，ARM7 系列使用3级流水线.n允许多个操作同时处理，比逐条指令执行要快。n PC指向正被取指的指令，而非正在执行的指令FetchDecodeExecute从存储器中读取指令解码指令寄存器读（从寄存器Bank）
10、移位及ALU操作寄存器写（到寄存器Bank）PCPCPC-4PC-2PC-8PC-4ARMThumb第二十二张，PPT共八十三页，创作于2022年6月最佳流水线n该例中用6个时钟周期执行了6条指令n所有的操作都在寄存器中（单周期执行）n指令周期数(CPI)=1 操作操作周期周期 1 2 3 45 6 ADD SUB MOV AND ORR EOR CMP RSBFetchDecodeExecuteFetchDecodeExecuteFetchDecodeExecuteFetchDecodeExecuteFetchDecodeExecuteDecodeExecuteFetchDecodeFetc
11、hFetch第二十三张，PPT共八十三页，创作于2022年6月LDR流水线举例nLDR R2,R3,#0 x0C!n该例中，用6周期执行了4条指令n指令周期数(CPI)=1.5 周期周期 操作操作123456 ADD SUB LDR MOV AND ORRFetchDecodeExecuteFetchDecodeExecuteFetchDecodeExecuteDataWritebackFetchDecodeExecuteFetchDecodeFetch第二十四张，PPT共八十三页，创作于2022年6月嵌入式微处理器的指令集n为满足应用领域的需要，嵌入式微处理器的指令集一般要针对特定领域的应用
12、进行剪裁和扩充。n类似于DSP的数字处理功能:n乘加(MAC)操作：它在一个周期中执行了一次乘法运算和一次加法运算。nSIMD类操作：允许使用一条指令进行多个并行数据流的计算。n零开销的循环指令：采用硬件方式减少了循环的开销。n多媒体加速指令：像素处理、多边形、3D操作等指令。第二十五张，PPT共八十三页，创作于2022年6月嵌入式微处理器的性能n低端（低价，低性能）n一般低端嵌入式微处理器的性能最多达到50MIPS，应用在对性能要求不高但对价格和功耗有严格要求的应用系统中。n中档，低功耗n中档的嵌入式微处理器可达到较好的性能（如150MIPS以上），采用增加时钟频率、加深流水深度、增加Cac
13、he及一些额外的功能块来提高性能，并保持低功耗。n高端n高端嵌入式微处理器用于高强度计算的应用，使用不同的方法来达到更高的并行度.第二十六张，PPT共八十三页，创作于2022年6月嵌入式微处理器的功耗管理n大多数嵌入式系统有功耗的限制（特别是电池供电的系统），它们不支持使用风扇和其他冷却设备。n降低工作电压n提供不同的时钟频率n关闭暂时不使用的功能块n提供功耗管理机制n总线及存储器对其的影响第二十七张，PPT共八十三页，创作于2022年6月嵌入式处理器体系结构n按体系结构的不同可分为五大类nARMnMIPSnPOWERPCnSH系列nX86架构(CISC)第二十八张，PPT共八十三页，创作于2
14、022年6月第二十九张，PPT共八十三页，创作于2022年6月ARM微处理器nARM处理器具有RISC体系结构的典型特征，同时具有以下特点:n在每条数据处理指令当中，都控制算术逻辑单元ALU和移位器，以使ALU和移位器获得最大的利用率；n自动递增和自动递减的寻址模式，以优化程序中的循环；n同时Load和Store多条指令，以增加数据吞吐量n所有指令都可以条件执行，以增大执行吞吐量；n这些是对基本RISC体系结构的增强，使得ARM处理器可以在高性能、小代码尺寸、低功耗和小芯片面积之间获得好的平衡。第三十张，PPT共八十三页，创作于2022年6月ARM微处理器：编程模型n数据类型n字节型数据（By
15、te）：数据宽度为8bitsn半字数据类型（HalfWord）：数据宽度为16bits，存取式必须以2字节对齐的方式n字数据类型（Word）：数据宽度为32bits，存取式必须以4字节对齐的方式第三十一张，PPT共八十三页，创作于2022年6月ARM微处理器：CPU模式7 7种种种种CPUCPU模式模式模式模式 第三十二张，PPT共八十三页，创作于2022年6月ARM微处理器：处理器工作状态n处理器有两种工作状态：nARM：32位，执行字对准的ARM指令nThumb：16位，执行半字对准的Thumb指令nARM和Thumb之间状态的切换不影响处理器的模式或寄存器的内容第三十三张，PPT共八十三
16、页，创作于2022年6月ARM微处理器：处理器工作状态n进入Thumb状态：n执行BX指令，并设置操作数寄存器的状态（位0）为1。n在Thumb状态进入异常(IRQ,FIQ,UNDEF,ABORT,SWIetc.)，当异常处理返回时自动转换到Thumb状态n进入ARM状态：n执行BX指令，并设置操作数寄存器的状态（位0）为0。n进入异常时，将PC放入异常模式链接寄存器中，从异常向量地址开始执行也可进入ARM状态第三十四张，PPT共八十三页，创作于2022年6月ARM微处理器：寄存器nARM处理器有37个寄存器n 31个通用寄存器：程序计数器、堆栈及其他通用寄存器n6个状态寄存器n这些寄存器不能
17、同时看到n不同的处理器状态和工作模式确定哪些寄存器是对编程者是可见的第三十五张，PPT共八十三页，创作于2022年6月ARM微处理器：ARMState寄存器第三十六张，PPT共八十三页，创作于2022年6月ARM微处理器:ThumbState寄存器第三十七张，PPT共八十三页，创作于2022年6月ARMState与ThumbState寄存器关系第三十八张，PPT共八十三页，创作于2022年6月ARM微处理器：程序状态寄存器nCPSR（当前程序状态寄存器）在所有的模式下都是可以读写的，它主要包含：n条件标志n中断使能标志n当前处理器的模式n其它的一些状态和控制标志第三十九张，PPT共八十三页，创
18、作于2022年6月ARM微处理器：程序状态寄存器n模式控制位M0-M4第四十张，PPT共八十三页，创作于2022年6月ARM微处理器：异常nARMCPU将引起异常的类型分为7种第四十一张，PPT共八十三页，创作于2022年6月ARM微处理器：异常n异常的优先级第四十二张，PPT共八十三页，创作于2022年6月ARM微处理器：内存和I/OnARM的寻址空间是线性的地址空间，为232=4GnBytes0to3存储第一个word,bytes4to7存储第二个字nARM支 持 大 端（Big-endian）和 小 端（Little-endian）的内存数据方式，可以通过硬件的方式设置（没有提供软件的方
19、式）端模式第四十三张，PPT共八十三页，创作于2022年6月ARM微处理器：内存和I/O大端的数据存放格式大端的数据存放格式第四十四张，PPT共八十三页，创作于2022年6月ARM微处理器：内存和I/O小端的数据格式小端的数据格式 第四十五张，PPT共八十三页，创作于2022年6月ARM微处理器：内存和I/On实例n变量A：wordA=0 xf6734bcd，在内存中的起始地址为0 xb3204500n变量B：halfwordB=218，在内存中的起始地址为0 xddddddd0第四十六张，PPT共八十三页，创作于2022年6月ARM微处理器：内存和I/On大端小端0 xb32045000 x
20、ddddddd00 xb32045000 xddddddd0f6f673734b4bcdcddada0000第四十七张，PPT共八十三页，创作于2022年6月主要内容1 13 32 24 4基本组成嵌入式处理器总线存储器第四十八张，PPT共八十三页，创作于2022年6月总线n总线的主要参数有n总线的带宽：又称总线位宽，指的是总线能同时传送数据的位数。n总线的位宽：又称总线的数据传送率，是指在一定时间内总线上可传送的数据总量，用每秒最大传送数据量来衡量。总线带宽越宽，传输率越高n总线的工作时钟频率：工作频率越高，速度越快。n总线的类型n按相对于CPU位置划分片外总线、片内总线n按功能和信号类型D
21、B、AB、CB第四十九张，PPT共八十三页，创作于2022年6月概述n一个微处理器系统可能含有多条总线n高速设备可以连到高速总线上。n低速设备可以连到低速总线上。n桥：总线互联的电路。n原因：n数据宽度：高速总线通常提供较宽的数据连接。n成本：高速总线通常采用更昂贵的电路和连接器。n桥允许总线独立操作，这样在I/O操作中可提供某些并行性。第五十张，PPT共八十三页，创作于2022年6月概述存储器存储器高速设备高速设备CPU CPU 低速设备低速设备低速设备低速设备桥桥高速总线高速总线低速总线低速总线多总线系统多总线系统第五十一张，PPT共八十三页，创作于2022年6月概述第五十二张，PPT共八
22、十三页，创作于2022年6月概述Processor-local busMicro-processorCacheMemorycontrollerDMAcontrollerBridgePeripheralPeripheralPeripheralPeripheral bus 外设总线外设总线嵌入式系统总线嵌入式系统总线第五十三张，PPT共八十三页，创作于2022年6月AMBA总线nAMBA（AdvancedMicrocontrollerBusArchitecture）是ARM公司研发的一种总线规范，目前为3.0版本。n在AMBA总线规范中，定义了3种总线:nAHB(AdvancedHigh-perf
23、ormanceBus)：用于高性能系统模块的连接，支持突发模式数据传输和事务分割；可以有效地连接处理器、片上和片外存储器，支持流水线操作。nASB（AdvancedSystemBus）：也用于高性能系统模块的连接，由AHB总线替代；nAPB（AdvancedPeripheralBus）：用于较低性能外设的简单连接，一般是接在AHB或ASB系统总线上的第二级总线。第五十四张，PPT共八十三页，创作于2022年6月AMBA总线外部总线外部总线APBAPB系统总线系统总线AHBAHB测试接测试接口口ARMARMCPUCPUSDRAMSDRAMControlControlSRAMSRAMLCDLCDC
24、ontrolControl桥桥并行接并行接口口串行串行接口接口TimerTimerUARTUART基于基于AMBA总线的典型系统总线的典型系统第五十五张，PPT共八十三页，创作于2022年6月AMBA总线-AHBnAHB总线主要由主单元、从单元、仲裁器和译码器组成。nAHB主单元:n只有主单元可在任何时刻使用总线。nAHB可以有一个或多个主单元。n主单元可以是RISC处理器、协处理器以及DMA控制器，以启动和控制总线操作。第五十六张，PPT共八十三页，创作于2022年6月AMBA总线-AHBnAHB从单元:n可以响应（并非启动）读或写总线操作。n总线的从单元可以在给定的地址范围内对读写操作进行
25、相应的反应。n从单元向主单元发出成功、失败信号或等待各种反馈信号。n从单元通常是其复杂程度不足以成为主单元的固定功能块，例如外存接口、总线桥接口以及任何内存都可以是从单元，系统的其他外设也包含在AHB的从单元中。第五十七张，PPT共八十三页，创作于2022年6月AMBA总线-AHBnAHB仲裁器n用来确定控制总线是哪个主单元，以保证在任何时候只有一个主单元可以启动数据传输。nAHB译码器n总线译码器用于传输译码工作，提供传输过程中从单元的片选信号。第五十八张，PPT共八十三页，创作于2022年6月AMBA总线-AHBn一个典型的AHB总线工作过程，它包括以下两个阶段：n地址传送阶段(addre
26、ssphase)：它将只持续一个时钟周期。在HCLK的上升沿数据有效。所有的从单元都在这个上升沿来采样地址信息。n数据传送阶段（dataphase）：它需要一个或几个时钟周期。可以通过HREADY信号来延长数据传输时间，当HREADY信号为低电平时，就在数据传输中加入等待周期，直到HREADY信号为高电平才表示这次传输阶段结束。第五十九张，PPT共八十三页，创作于2022年6月AMBA总线-AHBData（A）HADDR31:0HWDATA31:0Address phaseData phaseControlAControlData（A）HCLKHREADYAHB总线工作过程总线工作过程HRDA
27、TA31:0第六十张，PPT共八十三页，创作于2022年6月AMBA总线-APBAPB桥的接口信号桥的接口信号第六十一张，PPT共八十三页，创作于2022年6月AMBA总线-APB第六十二张，PPT共八十三页，创作于2022年6月PCI总线：特点nPCI总线是地址、数据多路复用的高性能32位和64位总线。是微处理器与外围设备控制部件、外围附加板之间的互连机构。n2.1版本定义了64位总线扩展和66MHz总线时钟的技术规范。n从数据宽度上看，PCI总线有32bit、64bit之分n从总线速度上分，有33MHz、66MHz两种nPCI总线的地址总线与数据总线是分时复用的，支持即插即用(Plugan
28、dPlay)、中断共享等功能。第六十三张，PPT共八十三页，创作于2022年6月PCI总线：信号定义n32位PCI系统的管脚按功能来分有以下几类:n系统控制nCLK：PCI时钟，上升沿有效；nRST：Reset信号n传输控制nFRAME#：标志传输开始与结束nIRDY#：Master可以传输数据的标志nDEVSEL#：当Slave发现自己被寻址时设置低电平应答nTRDY#：Slave可以传输数据的标志nSTOP#：Slave主动结束传输数据；nIDSEL：在即插即用系统启动时用于选中板卡的信号。第六十四张，PPT共八十三页，创作于2022年6月PCI总线：信号定义n地址与数据总线nAD31:0
29、：地址/数据分时复用总线；nC/BE#3:0：命令/字节使能信号；nPAR：奇偶校验信号。n仲裁信号nREQ#：Master用来请求总线使用权；nGNT#：仲裁机构允许Master得到总线使用权n错误报告nPERR#：数据奇偶校验错；nSERR#：系统奇偶校验错。第六十五张，PPT共八十三页，创作于2022年6月PCI总线：操作nPCI总线进行读操作时n发起者先置REQ#,当得到仲裁器的许可时(GNT#)，将FRAME#置低电平，并在AD总线上放置Slave地址，同时C/BE#放置命令信号，说明接下来的传输类型。nPCI 总线上的所有设备都需对此地址译码，被选中的设备置DEVSEL#以声明自己
30、被选中。然后当IRDY#与TRDY#都置低时，传输数据。nMaster在数据传输结束前，将FRAME#置高以标明只剩最后一组数据要传输，并在传完数据后放开IRDY#以释放总线控制权。第六十六张，PPT共八十三页，创作于2022年6月PCI总线-读操作Data传传送送WaitData传传送送WaitData传传送送WaitBE#sAddress phaseIRDY#981765432地址地址Data-1 Data-2Data-3命令命令Data phaseData phaseData phaseCLKFRAME#AD 31:0 C/BE#3:0 TRDY#DEVSEL#第六十七张，PPT共八十三
31、页，创作于2022年6月PCI力不从心n南桥/北桥nIntel440系列以后nPCI地位大大降低nFSB第六十八张，PPT共八十三页，创作于2022年6月CPCI总线3U（100mm 160mm）6U（233mm 160mm）第六十九张，PPT共八十三页，创作于2022年6月触摸屏n嵌入式系统中的触摸屏分为电阻式、电容式、电感式、红外线式和表面声波n其中电阻式触摸屏最为常用n电阻触摸屏的工作部分一般由三部分组成，两层透明的阻性导体层、两层导体之间的隔离层、电极n触摸屏工作时，上下导体层相当于电阻网络，当某一层电极加上电压时，会在该网络上形成X,Y方向上的梯度电压。n如有外力使得上下两层在某一点
32、接触，则在电极未加电压的另一层可以测得接触点处的电压，从而知道接触点处的(X,Y)坐标。第七十张，PPT共八十三页，创作于2022年6月电容式触摸屏n电容式触摸屏是一块四层复合玻璃屏，玻璃屏的内表面和夹层各涂一层ITO（氧化铟锡），四个角引出四个电极n当用户触摸电容屏时，由于人体电场，用户手指和工作面形成一个耦合电容n因为工作面上接有高频信号，于是手指会吸收一个很小的电流，这个电流分别从屏的四个角上的电极中流出n理论上流经四个电极的电流与手指头到四角的距离成比例，控制器通过对四个电流比例的精密计算，得出位置第七十一张，PPT共八十三页，创作于2022年6月红外式触摸屏n红外触摸屏是利用X、Y方
33、向上密布的红外线矩阵来检测并定位用户的触摸位置。红外触摸屏在显示器的前面安装一个电路板外框，电路板在屏幕四边排布红外发射管和红外接收管，一一对应形成横竖交叉的红外线矩阵。n用户在触摸屏幕时，手指就会挡住经过该位置的横竖两条红外线，因而可以判断出触摸点在屏幕的位置。任何触摸物体都可改变触点上的红外线而实现触摸屏操作。第七十二张，PPT共八十三页，创作于2022年6月主要内容1 13 32 24 4基本组成嵌入式处理器总线存储器第七十三张，PPT共八十三页，创作于2022年6月存储器种类RAM：随机存取存储器SRAM：静态随机存储器 vs DRAM：动态随机存储器 1）SRAM比DRAM快，电路复
34、杂，价格贵 2）DRAM存储密度比SRAM高得多 3）SRAM比DRAM耗电多 4）DRAM需要周期性刷新ROM：只读存储器EPROMEEPROMFLASH：闪存第七十四张，PPT共八十三页，创作于2022年6月高速缓存（CACHE）1 1、为什么采用高速缓存、为什么采用高速缓存 微处理器的时钟频率比内存访问速度提高快得多，高速缓存可以提高内微处理器的时钟频率比内存访问速度提高快得多，高速缓存可以提高内存的平均性能。存的平均性能。2 2、高速缓存的工作原理、高速缓存的工作原理 高速缓存是一种小型、快速、价格较贵的存储器，它保存部分主存高速缓存是一种小型、快速、价格较贵的存储器，它保存部分主存内
35、容的拷贝。内容的拷贝。CPU高速缓存控制器CACHE主存数据数据地址第七十五张，PPT共八十三页，创作于2022年6月闪速存储器(FLASH)n相对传统的EPROM芯片，这种芯片可以用电气的方法快速地擦写n由于块擦写存储器不需要存储电容器，故其集成度更高，制造成本低于DRAMn它使用方便，既具有SRAM读写的灵活性和较快的访问速度，又具有ROM在断电后可不丢失信息的特点，所以快擦写存储器技术发展十分迅速第七十六张，PPT共八十三页，创作于2022年6月NOR技术nNOR技术闪速存储器是最早出现的Flash Memory，目前仍是多数供应商支持的技术架构，它源于传统的EPROM器件。n与其它Fl
36、ash Memory技术相比，具有可靠性高、随机读取速度快的优势，但擦除和写的速度较NAND慢。n在擦除和编程操作较少而直接执行代码的场合，尤其是代码（指令）存储的应用中广泛使用。n由于NOR技术Flash Memory的擦除和编程速度较慢，而块尺寸又较大，因此擦除和编程操作所花费的时间很长，在纯数据存储和文件存储的应用中，NOR技术显得力不从心。第七十七张，PPT共八十三页，创作于2022年6月NAND技术nNAND技术FlashMemory具有以下特点：n以页为单位进行读和编程操作，1页为256或512字节；以块为单位进行擦除操作，1块为4K、8K或16K字节。具有快编程和快擦除的功能，其
37、块擦除时间是2ms；而NOR技术的块擦除时间达到几百ms。n数据、地址采用同一总线，实现串行读取。随机读取速度慢且不能按字节随机编程。n芯片尺寸小，引脚少，是位成本(bitcost)最低的固态存储器，突破了每兆字节0.1元的价格限制。n芯片包含有失效块，其数目最大可达到335块（取决于存储器密度）。失效块不会影响有效块的性能，但设计者需要将失效块在地址映射表中屏蔽起来。n基于NAND的存储器可以取代硬盘或其它块设备。第七十八张，PPT共八十三页，创作于2022年6月常见的存储器扩充装置nCF（CompactFlash）n1994年由SanDisk最先推出，大小为43mmx36mmx3.3mm，
38、重14g。目前容量可达4GByte。n缺点：体积太大，温度限制（040摄氏度）第七十九张，PPT共八十三页，创作于2022年6月常见的存储器扩充装置nMMC(Multi-MediaCard)n由SanDisk和Siemens公司在1997年发起，只有普通的邮票大小，外形尺寸32mm24mm1.4mm，而其重量不超过2g。目前容量可达4GByte。第八十张，PPT共八十三页，创作于2022年6月常见的存储器扩充装置nSD扩充装置（SecureDigital）nSD卡由日本松下、东芝及美国SanDisk公司于1999年8月共同开发研制，24mm32mm2.1mm，2g。目前容量可达4GByte。第八十一张，PPT共八十三页，创作于2022年6月常见的存储器扩充装置nMemoryStick(MS卡)nSony专用产品，大小为31201.6mm，2g。目前容量可达2GByte.第八十二张，PPT共八十三页，创作于2022年6月感谢大家观看第八十三张，PPT共八十三页，创作于2022年6月