《15异步时序电路分析.ppt》由会员分享，可在线阅读，更多相关《15异步时序电路分析.ppt（10页珍藏版）》请在taowenge.com淘文阁网|工程机械CAD图纸|机械工程制图|CAD装配图下载|SolidWorks_CaTia_CAD_UG_PROE_设计图分享下载上搜索。
1、6.4 异步时序逻辑电路的分析异步时序逻辑电路的分析一一.异步时序逻辑电路的分析方法：异步时序逻辑电路的分析方法：分析步骤分析步骤:3.3.确定电路的逻辑功能确定电路的逻辑功能。2.2.列出状态转换表或画出状态图和波形图列出状态转换表或画出状态图和波形图；1.1.写出下列各逻辑方程式：写出下列各逻辑方程式：b)b)触发器的激励方程；触发器的激励方程；c)c)输出方程输出方程d)d)状态方程状态方程a)a)时钟方程时钟方程（1）分析状态转换时必须考虑各触发器的时钟信号作用情况）分析状态转换时必须考虑各触发器的时钟信号作用情况有作用，则令有作用，则令cpn=1；否则；否则cpn=0根据激励信号确定
2、那些根据激励信号确定那些cpn=1的触发器的次态，的触发器的次态，cpn=0的触发的触发器则保持原有状态不变。器则保持原有状态不变。（2）每一次状态转换必须从输入信号所能触发的第一个触发器）每一次状态转换必须从输入信号所能触发的第一个触发器开始逐级确定开始逐级确定（3）每一次状态转换都有一定的时间延迟）每一次状态转换都有一定的时间延迟同步时序电路的所有触发器是同时转换状态的，与之不同，异同步时序电路的所有触发器是同时转换状态的，与之不同，异步时序电路各个触发器之间的状态转换存在一定的延迟，也就步时序电路各个触发器之间的状态转换存在一定的延迟，也就是说，从现态是说，从现态Sn到次态到次态Sn+1
3、的转换过程中有一段的转换过程中有一段“不稳定不稳定”的时的时间。在此期间，电路的状态是不确定的。只有当全部触发器状间。在此期间，电路的状态是不确定的。只有当全部触发器状态转换完毕，电路才进入新的态转换完毕，电路才进入新的“稳定稳定”状态，即次态状态，即次态Sn+1。注意注意:例例1 1 分析如图所示异步电路分析如图所示异步电路1.1.写出电路方程式写出电路方程式 时钟方程时钟方程输出方程输出方程激励方程激励方程 CP0=CLK求电路状态方程求电路状态方程 触发器如有时钟脉冲的上升沿作用时，其状态变化；触发器如有时钟脉冲的上升沿作用时，其状态变化；如无时钟脉冲上升沿作用时，其状态不变。如无时钟脉
4、冲上升沿作用时，其状态不变。CP1=Q0二二.异步时序逻辑电路的分析举例异步时序逻辑电路的分析举例 3.3.3.3.列状态表、画状态图、波形图列状态表、画状态图、波形图列状态表、画状态图、波形图列状态表、画状态图、波形图 00 CP0CP1Q0Q1CP 1 11 1 0 x11 0 1 00 1 0 x00 0 1 1(X-无触发沿无触发沿 ,-有有触发沿触发沿)根据状态图和具体触发器的传输延迟时间根据状态图和具体触发器的传输延迟时间tpLH和和tpHL，可以画出时序图可以画出时序图 4.逻辑功能分析逻辑功能分析该电路是一个异步二进制减计数器，该电路是一个异步二进制减计数器，Z信号的上升沿可触
5、发借位信号的上升沿可触发借位操作。也可把它看作为一个序列信号发生器。操作。也可把它看作为一个序列信号发生器。例例2 2 分析如图所示异步时序逻辑电路分析如图所示异步时序逻辑电路.状态方程状态方程 时钟方程时钟方程 解解(1)1)列出各逻辑方程组列出各逻辑方程组 (2)列出列出 状态表状态表110100010010110100100100000cp0cp1cp2110001111010001011100001101000001001001111110（CP=0表示无时钟下降沿，表示无时钟下降沿，CP=1表示有时钟下降沿表示有时钟下降沿）电路是一个异步五进制加计数电路。电路是一个异步五进制加计数电路。(4)逻辑功能分析逻辑功能分析(3)画出状态画出状态图图