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1、2.6 80C51的并行口结构与操作的并行口结构与操作本章共分六节，主要讲述：本章共分六节，主要讲述：2.1 80C51系列概述系列概述2.2 80C51的基本结构与应用模式的基本结构与应用模式2.3 80C51典型产品资源配置与引脚封装典型产品资源配置与引脚封装2.4 80C51的内部结构的内部结构2.5 80C51的存储器组织的存储器组织2.1 80C512.1 80C51系列概述系列概述2.1.1 MCS-512.1.1 MCS-51系列系列 （1 1）MCS-51MCS-51是是IntelIntel公司生公司生产产的一个的一个单单片片机系列名称。属于机系列名称。属于这这一系列的一系列的
2、单单片机有多种，片机有多种，如：如：8051/8751/80318051/8751/8031；8052/8752/80328052/8752/8032；80C51/87C51/80C3180C51/87C51/80C31 80C52/87C52/80C3280C52/87C52/80C32等等。（2）该系列生产工艺有两种：）该系列生产工艺有两种：CHMOS是是CMOS和和HMOS的的结结合合，既既保保持持了了HMOS高高速速度度和和高高密密度度的的特特点点，还还具具有有CMOS的的低低功功耗耗的的特特点点。在在产产品品型型号号中中凡凡带带有有字字母母“C”的的即即为为CHMOS芯芯片片，CHM
3、OS芯芯片片的的电电平平既既与与TTL电电平平兼兼容容，又又与与CMOS电电平兼容。平兼容。一一是是HMOS工工艺艺（高高密密度度短短沟沟道道MOS工工艺艺）。二二是是CHMOS工工艺艺（互互补补金金属属氧氧化化物物的的HMOS工艺）。工艺）。（3）在功能上，该系列单片机有基本型）在功能上，该系列单片机有基本型和增强型两大类：和增强型两大类：增强型增强型：8052/8752/803280C52/87C52/80C32基本型基本型：8051/8751/803180C51/87C51/80C31（4）在在片片内内程程序序存存储储器器的的配配置置上上，该该系系列列单单片片机机有有三三种种形形式式，即
4、即掩掩膜膜ROM、EPROM和和ROMLess(无无片片内内程序存储器程序存储器)。如：。如：80C51有有4K字节的掩膜字节的掩膜ROM；87C51有有4K字节的字节的EPROM；80C31在芯片内无程序存储器。在芯片内无程序存储器。2.1.2 80C512.1.2 80C51系列系列 Intel的的：80C31、80C51、87C51，80C32、80C52、87C52等；等；ATMEL的：的：89C51、89C52、89C2051等；等；Philips、华华邦、邦、Dallas、Siemens(Infineon)等公等公司的司的许许多多产产品品。http:/ 80C51是是MCS-51系
5、系列列中中CHMOS工工艺艺的的一一个个典典型型品品种种；其其它它厂厂商商以以8051为为基基核核开开发发出出的的CMOS工工艺艺单单片片机机产产品品统统称称为为80C51系系列列。当前常用的当前常用的80C51系列系列单单片机主要片机主要产产品有：品有：2.2 80C512.2 80C51的基本的基本结结构与构与应应用模式用模式2.2.1 80C512.2.1 80C51的基本的基本结结构构2.2.2 80C512.2.2 80C51的的应应用模式用模式 一、一、总线型单片机应用模式总线型单片机应用模式总线型应用的总线型应用的“三总线三总线”模式模式 非总线型应用的非总线型应用的“多多I/O
6、”模式模式 二、非总线型单片机应用模式二、非总线型单片机应用模式 非总线型单片机已经将用于外部总线扩非总线型单片机已经将用于外部总线扩展用的展用的I/OI/O口线和控制功能线去掉，从而使口线和控制功能线去掉，从而使单片机的单片机的引脚数减少、体积减小引脚数减少、体积减小。对于不。对于不需进行并行外围扩展，装置的体积要求苛需进行并行外围扩展，装置的体积要求苛刻且程序量不大的系统极其适合。非总线刻且程序量不大的系统极其适合。非总线型单片机典型产品如：型单片机典型产品如：AT89C2051/AT89C4051AT89C2051/AT89C4051。2.3 80C51典型典型产产品品资资源配置与引脚源
7、配置与引脚2.3.1 80C512.3.1 80C51典型典型产产品品资资源配置源配置由表可见：由表可见：（1）增强型与基本型在以下几点不同：）增强型与基本型在以下几点不同：片内片内ROM字节数：从字节数：从4K增加到增加到8K；片内片内RAM字节数：从字节数：从128增加到增加到256；定时定时/计数器从计数器从2个增加到个增加到3个个；中断源由中断源由5个增加到个增加到6个个。http:/（2）片内）片内ROM的配置形式：的配置形式：无无ROM（即（即ROMLess）型，应用时要在片外扩）型，应用时要在片外扩展程序存储器；展程序存储器；掩膜掩膜ROM（即（即MaskROM）型，用户程序由芯
8、）型，用户程序由芯片生产厂写入；片生产厂写入；EPROM型，用户程序通过写入装置写入，通型，用户程序通过写入装置写入，通过紫外线照射擦除；过紫外线照射擦除；FlashROM型，用户程序可以电写入或擦除型，用户程序可以电写入或擦除（当前常用方式）。（当前常用方式）。还有还有OTPROM型（一次性编程写入型（一次性编程写入ROM）产产品，具有较高的环境适应性和可靠性。品，具有较高的环境适应性和可靠性。2.3.2 80C512.3.2 80C51的引脚封装的引脚封装总线型总线型非总线型非总线型2.4 80C512.4 80C51的内部的内部结结构构 2.4.1 80C512.4.1 80C51的内部
9、的内部结结构构一、一、80C51的微处理器（的微处理器（CPU）（1）运算器）运算器累加器累加器ACC；寄存器寄存器B；程序状态字寄存器程序状态字寄存器PSW。（2）控制器）控制器程序计数器程序计数器PC；指令寄存器指令寄存器IR；定时与控制逻辑。定时与控制逻辑。二、二、80C51的片内存储器的片内存储器 在物理上设计成在物理上设计成程序存储器程序存储器和和数据存储器数据存储器两个两个独立的空间独立的空间（称为（称为哈佛结构哈佛结构）：）：内部内部ROM容量容量4K字节字节 范围是：范围是：000H0FFFH 内部内部RAM容量容量128字节字节 范围是：范围是：00H7FH三、三、80C51
10、的的I/O口及功能单元口及功能单元四个四个8位的并行口，即位的并行口，即P0P3。它们均为双。它们均为双向口，既可作为输入，又可作为输出。每向口，既可作为输入，又可作为输出。每个口各有个口各有8条条I/O线。线。有一个全双工的串行口有一个全双工的串行口（利用（利用P3口的两个口的两个引脚引脚P3.0和和P3.1）；）；有有2个个16位的定时位的定时/计数器计数器；有有1套完善的中断系统。套完善的中断系统。四、四、80C5180C51的特殊功能寄存器（的特殊功能寄存器（SFRSFR）内部有内部有SPSP，DPTRDPTR（可分成（可分成DPHDPH、DPLDPL两个两个8 8位位寄存器），寄存器
11、），PCONPCON，IEIE，IPIP等等2121个特殊功个特殊功能寄存器单元，能寄存器单元，它们同内部它们同内部RAMRAM的的128128个字节个字节统一编址，地址范围是统一编址，地址范围是80H80HFFHFFH。这些。这些SFRSFR只只用到了用到了80H80HFFHFFH中的中的2121个字节单元，且这些个字节单元，且这些单元是离散分布的。单元是离散分布的。增强型单片机的增强型单片机的SFRSFR有有2626个字节单元，所增加个字节单元，所增加的的5 5个单元均与定时个单元均与定时/计数器计数器2 2相关。相关。2.4.2 80C512.4.2 80C51的的时钟时钟与与时时序序一
12、、一、80C5180C51的时钟产生方式的时钟产生方式内部时钟内部时钟 外部时钟外部时钟二、二、80C51的时钟信号的时钟信号一个一个机器周期机器周期包含包含12个晶荡周期或个晶荡周期或6个时钟周期个时钟周期 指令的执行时间称作指令的执行时间称作指令周期指令周期（单、双、四周期）二、二、80C51的典型时序的典型时序 各指令的微操作在时间上有严格的次序，这各指令的微操作在时间上有严格的次序，这种种微操作的时间次序微操作的时间次序我们称作我们称作时序。时序。单字节指令单字节指令 双字节指令双字节指令1、单周期指令时序、单周期指令时序 2个机器周期中个机器周期中ALE信号有效信号有效4次，后次，后
13、3次读操作无效。次读操作无效。2、双双周期指令时序周期指令时序 在第二机器周期无读操作码的操作，而是进行外部在第二机器周期无读操作码的操作，而是进行外部数据存储器的寻址和数据选通数据存储器的寻址和数据选通。ALE信号会出现非周期信号会出现非周期现象现象。访问外部访问外部RAM的双周期指令时序的双周期指令时序 2.4.3 80C512.4.3 80C51单单片机的复位片机的复位一、复位电路一、复位电路复位复位目的是目的是使单片机使单片机或系统中的其它部件或系统中的其它部件处于某种处于某种确定的初始状态。确定的初始状态。上电复位电路上电复位电路 按键与上电复位按键与上电复位 二、单片机复位后的状态
14、二、单片机复位后的状态PC=0000H，所以程序从，所以程序从0000H地址单元开始执行地址单元开始执行；启动后，片内启动后，片内RAM为随机值，运行中的复位操作不为随机值，运行中的复位操作不改变片内改变片内RAM的内容的内容；特殊功能寄存器复位后的状态是确定的特殊功能寄存器复位后的状态是确定的：P0P3=FFH，各口可用于输出，也可用于输入；，各口可用于输出，也可用于输入；SP=07H，第一个入栈内容将写入，第一个入栈内容将写入08H单元；单元；IP、IE和和PCON的的有效位为有效位为0，各中断源处于低优先，各中断源处于低优先级且均被关断、串行通讯的波特率不加倍；级且均被关断、串行通讯的波
15、特率不加倍；PSW=00H，当前工作寄存器为，当前工作寄存器为0组。组。http:/2.5 80C512.5 80C51的存的存储储器器组织组织80C51存储器可以分成两大类：存储器可以分成两大类：RAM，CPU在运行时能随时进行数据的写入和在运行时能随时进行数据的写入和读出，但在关闭电源时，其所存储的信息将丢失。读出，但在关闭电源时，其所存储的信息将丢失。它用来存放暂时性的输入输出数据、运算的中间它用来存放暂时性的输入输出数据、运算的中间结果或用作堆栈。结果或用作堆栈。ROM是一种写入信息后不易改写的存储器。断是一种写入信息后不易改写的存储器。断电后，电后，ROM中的信息保留不变。用来存放固
16、定的中的信息保留不变。用来存放固定的程序或数据，如系统监控程序、常数表格等。程序或数据，如系统监控程序、常数表格等。2.5.1 80C512.5.1 80C51的程序存的程序存储储器配置器配置PC是是16位的计数器，所以能寻址位的计数器，所以能寻址64KB的的ROM。80C51内部有内部有4KB的掩膜的掩膜ROM，87C51在内部有在内部有4KB的的EPROM，而，而80C31在内部没有程序存储器。在内部没有程序存储器。2.5.2 80C512.5.2 80C51的数据存的数据存储储器配置器配置一、工作寄存器区一、工作寄存器区 低端低端32个字节分成个字节分成4个工作寄存器组，每组个工作寄存器
17、组，每组8个单个单元。元。当前工作寄存器组的机制当前工作寄存器组的机制便于快速现场保护。便于快速现场保护。PSW的的RS1、RS0 决定当前工作寄存器组号决定当前工作寄存器组号 寄存器0组：地址00H07H；寄存器1组：地址08H0FH；寄存器2组：地址10H17H；寄存器3组：地址18H1FH。二、位寻址区二、位寻址区三、通用三、通用RAM区区 位寻址区之后的位寻址区之后的30H至至7FH共共80个字节个字节为为通用通用RAM区。这些单元可以作为数据缓冲区。这些单元可以作为数据缓冲器使用。这一区域的操作指令非常丰富，器使用。这一区域的操作指令非常丰富，数据处理方便灵活。数据处理方便灵活。在实
18、际应用中，常需在在实际应用中，常需在RAM区设置堆栈。区设置堆栈。80C51的的堆栈一般设在堆栈一般设在30H7FH的范围内的范围内。栈顶的位置由栈顶的位置由SP寄存器指示。寄存器指示。复位时复位时SP的的初值为初值为07H，在系统初始化时可以重新设置。，在系统初始化时可以重新设置。2.5.32.5.3 80C5180C51的特的特殊功能寄存殊功能寄存器（器（SFRSFR）一、与运算器相关的寄存器（一、与运算器相关的寄存器（3个）个）累加器累加器ACC，8位。用于向位。用于向ALU提供操作数，许多运提供操作数，许多运算的结果也存放在累加器中；算的结果也存放在累加器中；寄存器寄存器B，8位。主要
19、用于乘、除法运算。也可以作为位。主要用于乘、除法运算。也可以作为RAM的一个单元使用；的一个单元使用；程序状态字寄存器程序状态字寄存器PSW，8位。其各位含义为：位。其各位含义为：CY：进位、借位标志。有进位、借位时：进位、借位标志。有进位、借位时 CY=1，否则，否则CY=0；AC：辅助进位、借位标志；：辅助进位、借位标志；F0：用户标志位，由用户自己定义；：用户标志位，由用户自己定义；RS1、RS0：当前工作寄存器组选择位；：当前工作寄存器组选择位；OV：溢出标志位。有溢出时：溢出标志位。有溢出时OV=1，否则，否则OV=0；P：奇偶标志位。：奇偶标志位。ACC中结果有奇数个中结果有奇数个
20、1时时P=1，否则，否则 P=0。二、指针类寄存器（二、指针类寄存器（3个）个）堆栈指针堆栈指针SP，8位。它总是指向栈顶。位。它总是指向栈顶。堆栈操作遵循堆栈操作遵循“后进先出后进先出”的原则，入栈操作时，的原则，入栈操作时，SP先加先加1，数据再压入，数据再压入SP指向的单元。出栈操作时，指向的单元。出栈操作时，先将先将SP指向的单元的数据弹出，然后，指向的单元的数据弹出，然后，SP再减再减1，这，这时时SP指向的单元是新的栈顶。可见，指向的单元是新的栈顶。可见，80C51单片机的单片机的堆栈区是向地址增大的方向生成的。堆栈区是向地址增大的方向生成的。数据指针数据指针DPTR，16位。用来
21、存放位。用来存放16位的地址。位的地址。它由两个它由两个8位的寄存器位的寄存器DPH和和DPL组成。间接寻址组成。间接寻址或变址寻址可访问片外的或变址寻址可访问片外的64KB范围的范围的RAM或或ROM数据。数据。三、与口相关的寄存器（三、与口相关的寄存器（7个）个）并行并行I/O口口P0、P1、P2、P3，均为，均为8位；位；串行口数据缓冲器串行口数据缓冲器SBUF；串行口控制寄存器串行口控制寄存器SCON；串行通讯波特率倍增寄存器串行通讯波特率倍增寄存器PCON（一些位（一些位还与电源控制相关，所以又称为电源控制寄还与电源控制相关，所以又称为电源控制寄存器）。存器）。四、与中断相关的寄存器
22、（四、与中断相关的寄存器（2个）个）中断允许控制寄存器中断允许控制寄存器IE；中断优先级控制寄存器中断优先级控制寄存器IP。五、与定时器五、与定时器/计数器相关的寄存器（计数器相关的寄存器（6个）个）定时定时/计数器计数器T0的两个的两个8位计数初值寄存器位计数初值寄存器TH0、TL0，它们可以构成，它们可以构成16位的计数器，位的计数器，TH0存放高存放高8位，位，TL0存放低存放低8位；位；定时定时/计数器计数器T1的两个的两个8位计数初值寄存器位计数初值寄存器TH1、TL1，它们可以构成，它们可以构成16位的计数器，位的计数器，TH1存放高存放高8位，位，TL1存放低存放低8位；位；定时
23、定时/计数器的工作方式寄存器计数器的工作方式寄存器TMOD；定时定时/计数器的控制寄存器计数器的控制寄存器TCON。http:/2.6 80C51的并行口的并行口结结构与操作构与操作2.6.1 P0口、口、P2口的结构口的结构 一、一、P0口的结构口的结构1 1、P0P0用作通用用作通用I/OI/O口口 当系统不进行片外的当系统不进行片外的ROM扩展，也不进扩展，也不进行片外行片外RAM扩展时扩展时，P0用作通用用作通用I/O口口。在这种情况下，单片机硬件自动使在这种情况下，单片机硬件自动使C=0，MUX开关接向锁存器的反相输出端。开关接向锁存器的反相输出端。另外，与门输出的另外，与门输出的“
24、0”使输出驱动器的上拉使输出驱动器的上拉场效应管场效应管T1处于截止状态。因此，输出驱动处于截止状态。因此，输出驱动级工作在级工作在需外接上拉电阻需外接上拉电阻的的漏极开路漏极开路方式。方式。作输出口时，作输出口时，CPU执行口的输出指令，内部执行口的输出指令，内部数据总线上的数据在数据总线上的数据在“写锁存器写锁存器”信号的作用信号的作用下由下由D端进入锁存器，经锁存器的反向端送端进入锁存器，经锁存器的反向端送至场效应管至场效应管T2，再经，再经T2反向，在反向，在P0.X引脚引脚出现的数据正好是内部总线的数据。出现的数据正好是内部总线的数据。作输入口时，数据可以读自口的锁存器，作输入口时，
25、数据可以读自口的锁存器，也可以读自口的引脚。这要根据输入操作也可以读自口的引脚。这要根据输入操作采用的是采用的是“读锁存器读锁存器”指令还是指令还是“读引脚读引脚”指指令来决定。令来决定。执行执行“读读修改修改写写”类输入指令时类输入指令时（如：（如：ANL P0，A），内部产生的），内部产生的“读锁存器读锁存器”操作信号，使锁存器操作信号，使锁存器Q端数端数据进入内部数据总线，在与累加器据进入内部数据总线，在与累加器A进行逻辑运算之后，结果又送回进行逻辑运算之后，结果又送回P0的的口锁存器并出现在引脚。口锁存器并出现在引脚。读口锁存器可以避免因外部电路原因使读口锁存器可以避免因外部电路原因使
26、原口引脚的状态发生变化造成的误读。原口引脚的状态发生变化造成的误读。在执行在执行“MOVMOV”类输入指令时（如：类输入指令时（如：MOV MOV A A，P0P0），内部产生的操作信号是），内部产生的操作信号是“读引脚读引脚”。注意，在注意，在执行该类输入指令前要先把锁存器执行该类输入指令前要先把锁存器写入写入“1 1”，使场效应管，使场效应管T2T2截止，使引脚处于截止，使引脚处于悬浮状态，可以作为高阻抗输入。悬浮状态，可以作为高阻抗输入。否则，在作为输入方式之前曾向锁存器输否则，在作为输入方式之前曾向锁存器输出过出过“0 0”，则，则T2T2导通会使引脚箝位在导通会使引脚箝位在“0 0”
27、电平，使输入高电平电平，使输入高电平“1 1”无法读入。无法读入。所以，所以，P0P0口在作为通用口在作为通用I/OI/O口时，属于准双向口口时，属于准双向口。2、P0用作地址用作地址/数据总线数据总线 当系统进行片外的当系统进行片外的ROM扩展或进行扩展或进行片外片外RAM扩展，扩展，P0用作地址用作地址/数据总线数据总线时时。在这种情况下，单片机内硬件自动使在这种情况下，单片机内硬件自动使C=1，MUX开关接向反相器的输出端，开关接向反相器的输出端，这时与门的输出由地址这时与门的输出由地址/数据线的状态决数据线的状态决定。定。CPU在执行输出指令时，低在执行输出指令时，低8位地址信息和位地
28、址信息和数据信息分时地出现在地址数据信息分时地出现在地址/数据总线上。数据总线上。P0.X引脚的状态与地址引脚的状态与地址/数据线的信息相同。数据线的信息相同。CPU在执行输入指令时，首先低在执行输入指令时，首先低8位地址信位地址信息出现在地址息出现在地址/数据总线上，数据总线上，P0.X引脚的状态与地引脚的状态与地址址/数据总线的地址信息相同数据总线的地址信息相同。然后，。然后，CPU自动地使自动地使转换开关转换开关MUX拨向锁存器，并向拨向锁存器，并向P0口写入口写入FFH，同时，同时“读引脚读引脚”信号有效，信号有效，数据经缓冲器进数据经缓冲器进入内部数据总线入内部数据总线。P0口作为地
29、址口作为地址/数据总线使用时是一个真正数据总线使用时是一个真正的双向口的双向口。二、二、P2口的结构口的结构 1 1、P2P2用作通用用作通用I/OI/O口口 当不在单片机芯片外部扩展程序存储器，只当不在单片机芯片外部扩展程序存储器，只扩展扩展256B的片外的片外RAM时，仅用到了地址线的时，仅用到了地址线的低低8位，位，P2口仍可以作为通用口仍可以作为通用I/O口使用口使用。执行输出指令时，内部数据总线的数据在执行输出指令时，内部数据总线的数据在“写锁存写锁存器器”信号的作用下由信号的作用下由D端进入锁存器，经反相器后送端进入锁存器，经反相器后送至场效应管至场效应管T，再经，再经T反相，反相
30、，在在P2.X引脚出现的数据引脚出现的数据正好是内部总线的数据正好是内部总线的数据。http:/ P2口用作输入时，数据可以读自口的锁存器，口用作输入时，数据可以读自口的锁存器，也可以读自口的引脚。这要根据输入操作采用的是也可以读自口的引脚。这要根据输入操作采用的是“读锁存器读锁存器”指令还是指令还是“读引脚读引脚”指令来决定。指令来决定。执行执行“读读修改修改写写”类输入指令时内部产类输入指令时内部产生的生的“读锁存器读锁存器”操作信号使锁存器操作信号使锁存器Q端数据端数据进入内部数据总线，在与累加器进入内部数据总线，在与累加器A进行逻辑进行逻辑运算之后，结果又送回运算之后，结果又送回P2的
31、口锁存器并出现的口锁存器并出现在引脚。在引脚。执行执行“MOV”类输入指令时，内部产生的类输入指令时，内部产生的操作信号是操作信号是“读引脚读引脚”。应在执行输入指令前。应在执行输入指令前要把锁存器写入要把锁存器写入“1”，从而使引脚处高阻抗，从而使引脚处高阻抗输入状态。输入状态。P2口在作为通用口在作为通用I/O口时，属于准双向口口时，属于准双向口。2 2、P2P2用作地址总线用作地址总线 当需要在单片机芯片外部扩展程序存当需要在单片机芯片外部扩展程序存储器或扩展的储器或扩展的RAM容量超过容量超过256字节时字节时，单片机内硬件自动使控制单片机内硬件自动使控制C=1，MUX开开关接向地址线
32、，这时关接向地址线，这时P2.X引脚的状态正引脚的状态正好与地址线的信息相同好与地址线的信息相同。2.6.2 P12.6.2 P1口、口、P3P3口的结构口的结构 一、一、P1口的结构口的结构 P1口由一个输出锁存器、两个三态输口由一个输出锁存器、两个三态输入缓冲器和输出驱动电路组成。输出驱入缓冲器和输出驱动电路组成。输出驱动电路与动电路与P2口相同，内部设有上拉电阻。口相同，内部设有上拉电阻。P1口是通用的准双向口是通用的准双向I/O口。输出高口。输出高电平时，能向外提供拉电流负载，不必电平时，能向外提供拉电流负载，不必再接上拉电阻。当口用作输入时，须向再接上拉电阻。当口用作输入时，须向口锁
33、存器写入口锁存器写入1。二、二、P3口的结构口的结构 1 1、P3P3用作第一功能（通用用作第一功能（通用I/O口）口）对对P3口进行字节或位寻址时，单片机内部的硬件口进行字节或位寻址时，单片机内部的硬件自动将第二功能输出线的自动将第二功能输出线的W置置1。这时，对应的口线。这时，对应的口线为通用为通用I/O口方式。口方式。输出时，锁存器的状态（输出时，锁存器的状态（Q端）与输出引脚端）与输出引脚的状态相同；的状态相同；输入时，要先向口锁存器写入输入时，要先向口锁存器写入1，使引脚处，使引脚处于高阻输入状态。输入的数据在于高阻输入状态。输入的数据在“读引脚读引脚”信信号的作用下，进入内部数据总
34、线。号的作用下，进入内部数据总线。P3口作为通用口作为通用I/O口时，属于准双向口口时，属于准双向口。2 2、P3P3用作第二功能使用用作第二功能使用 当当CPU不对不对P3口进行字节或位寻址时，内部硬件口进行字节或位寻址时，内部硬件自动将口锁存器的自动将口锁存器的Q端置端置1。这时，。这时，P3口作为第二功口作为第二功能使用能使用。P3.0：RXD（串行口输入）；（串行口输入）；P3.1：TXD（串行口输出）；（串行口输出）；P3.2：外部中断外部中断0输入；输入；P3.3：外部中断外部中断1输入；输入；P3.4：T0（定时器（定时器0的外部输入）；的外部输入）；P3.5：T1（定时器（定时
35、器1的外部输出）；的外部输出）；P3.6：（片外数据存储器（片外数据存储器“写写”选通控制输出）；选通控制输出）；P3.7：（片外数据存储器（片外数据存储器“读读”选通控制输出）。选通控制输出）。2.6.3 2.6.3 并行口的负载能力并行口的负载能力 P0、P1、P2、P3口的口的电平电平与与CMOS和和TTL电平兼容。电平兼容。P0口的每一位口线可以口的每一位口线可以驱动驱动8个个LSTTL负载。负载。在在作为通用作为通用 I/O口口时，由于输出驱动电路是时，由于输出驱动电路是开漏方式，由集电极开路（开漏方式，由集电极开路（OC门）电路或门）电路或漏极开路电路驱动时漏极开路电路驱动时需外接
36、上拉电阻需外接上拉电阻；当作；当作为为地址地址/数据总线数据总线使用时，口线输出不是开漏使用时，口线输出不是开漏的，的，无须外接上拉电阻无须外接上拉电阻。P1、P2、P3口的每一位能驱动口的每一位能驱动4个个LSTTL负负载。它们的输出驱动电路设有内部上拉电阻，载。它们的输出驱动电路设有内部上拉电阻，所以可以方便地由集电极开路（所以可以方便地由集电极开路（OC门）电门）电路或漏极开路电路所驱动，而路或漏极开路电路所驱动，而无须外接上拉无须外接上拉电阻电阻。由于单片机口线仅能提供几毫安的电流，由于单片机口线仅能提供几毫安的电流，当作为输出驱动一般的晶体管的基极时，应当作为输出驱动一般的晶体管的基
37、极时，应在口与晶体管的基极之间串接限流电阻。在口与晶体管的基极之间串接限流电阻。思考题与习题思考题与习题1 1、80C5180C51在功能、工艺、程序存储器的配置上有哪些种类？在功能、工艺、程序存储器的配置上有哪些种类？2 2、80C5180C51的存储器组织采用何种结构？存储器地址空间如何划的存储器组织采用何种结构？存储器地址空间如何划分？各地址空间的地址范围和容量如何？在使用上有何特点？分？各地址空间的地址范围和容量如何？在使用上有何特点？3 3、80C5180C51的的P0P3P0P3口在结构上有何不同？在使用上有何特点？口在结构上有何不同？在使用上有何特点？4 4、80C5180C51
38、晶振频率为晶振频率为12MHz12MHz，时钟周期、机器周期为多少？，时钟周期、机器周期为多少？5 5、80C5180C51复位后的状态如何？复位方法有几种？复位后的状态如何？复位方法有几种？6 6、80C5180C51的片内、片外存储器如何选择？的片内、片外存储器如何选择？7 7、80C5180C51的的PSWPSW寄存器各位标志的意义如何？寄存器各位标志的意义如何？8 8、80C5180C51的当前工作寄存器组如何选择？的当前工作寄存器组如何选择？9 9、80C5180C51的控制总线信号有哪些？各信号的作用如何？的控制总线信号有哪些？各信号的作用如何？1010、80C5180C51的程序存储器低端的几个特殊单元的用途如何？的程序存储器低端的几个特殊单元的用途如何？