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1、第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构 2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 C54xC54x器件除了提供哈佛结构的总线、功能强大器件除了提供哈佛结构的总线、功能强大器件除了提供哈佛结构的总线、功能强大器件除了提供哈佛结构的总线、功能强大的的的的CPUCPU以及大容量的存储空间外，还提供了必要的片以及大容量的存储空间外，还提供了必要的片以及大容量的存储空间外，
2、还提供了必要的片以及大容量的存储空间外，还提供了必要的片内外部设备。内外部设备。内外部设备。内外部设备。不同型号的不同型号的不同型号的不同型号的 C54xC54x芯片，所配置的片内外设有所芯片，所配置的片内外设有所芯片，所配置的片内外设有所芯片，所配置的片内外设有所不同，这些片内外设主要包括：不同，这些片内外设主要包括：不同，这些片内外设主要包括：不同，这些片内外设主要包括：通用通用通用通用I/OI/O引脚引脚引脚引脚 定时器定时器定时器定时器 时钟发生器时钟发生器时钟发生器时钟发生器 主机接口主机接口主机接口主机接口HPIHPI 串行通信接口串行通信接口串行通信接口串行通信接口 软件可编程等
3、待软件可编程等待软件可编程等待软件可编程等待 状态发生器状态发生器状态发生器状态发生器 可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构1 1 1 1通用通用通用通用I/OI/OI/OI/O引脚引脚引脚引脚 C54xC54x芯片为用户提供了两个通用的芯片为用户提供了两个通用的芯片为用户提供了两个通用的芯片为用户提供了两个通用的I/OI/O引脚。引
4、脚。引脚。引脚。XFXF：用于程序向外设传输标志信息。用于程序向外设传输标志信息。用于程序向外设传输标志信息。用于程序向外设传输标志信息。通过此引脚的置位或复位，可以控制外设通过此引脚的置位或复位，可以控制外设通过此引脚的置位或复位，可以控制外设通过此引脚的置位或复位，可以控制外设 的工作。的工作。的工作。的工作。分支转移控制输入引脚分支转移控制输入引脚分支转移控制输入引脚分支转移控制输入引脚BIOBIO 外部标志输出引脚外部标志输出引脚外部标志输出引脚外部标志输出引脚XFXF BIOBIO：用来监控外部设备的运行状态。用来监控外部设备的运行状态。用来监控外部设备的运行状态。用来监控外部设备的
5、运行状态。在实时控制系统中，通过查询此引脚控制在实时控制系统中，通过查询此引脚控制在实时控制系统中，通过查询此引脚控制在实时控制系统中，通过查询此引脚控制 程序流向，以避免中断引起的失控现象。程序流向，以避免中断引起的失控现象。程序流向，以避免中断引起的失控现象。程序流向，以避免中断引起的失控现象。2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 l可以用软件控制改变上述引脚状态SSBX XF 置1RSBX XF 复位为0第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS32
6、0C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构2 2 2 2定时器定时器定时器定时器 C54xC54x的定时器是一个带有的定时器是一个带有的定时器是一个带有的定时器是一个带有4 4位预分频器位预分频器位预分频器位预分频器的的的的1616位可位可位可位可软件编程减法计数器软件编程减法计数器软件编程减法计数器软件编程减法计数器。这个这个这个这个减法计数器减法计数器减法计数器减法计数器每来每来每来每来1 1个时钟周期自动减个时钟周期自动减个时钟周期自动减个时钟周期自动减1 1，当计，当计，当计，当计数器减到数器减到数器减到数器减到0 0时产生定时中断。时产
7、生定时中断。时产生定时中断。时产生定时中断。通过编程设置特定的状态可使定时器停止、恢复通过编程设置特定的状态可使定时器停止、恢复通过编程设置特定的状态可使定时器停止、恢复通过编程设置特定的状态可使定时器停止、恢复运行、复位或禁止。运行、复位或禁止。运行、复位或禁止。运行、复位或禁止。2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构2
8、 2 2 2定时器定时器定时器定时器 C54xC54x的定时器主要包括的定时器主要包括的定时器主要包括的定时器主要包括3 3个存储器映像寄存器：个存储器映像寄存器：个存储器映像寄存器：个存储器映像寄存器：定时设定寄存器定时设定寄存器定时设定寄存器定时设定寄存器TIMTIM 定时周期寄存器定时周期寄存器定时周期寄存器定时周期寄存器PRDPRD 定时控制寄存器定时控制寄存器定时控制寄存器定时控制寄存器TCRTCR 定时设定寄存器定时设定寄存器定时设定寄存器定时设定寄存器TIMTIM 它是一个它是一个它是一个它是一个1616位减法计数器位减法计数器位减法计数器位减法计数器，映射到数据存储空间的，映射
9、到数据存储空间的，映射到数据存储空间的，映射到数据存储空间的00240024HH单元。复位或定时器中断（单元。复位或定时器中断（单元。复位或定时器中断（单元。复位或定时器中断（TINTTINT）时，时，时，时，TIMTIM内装入内装入内装入内装入PRDPRD寄存寄存寄存寄存器的值（定时时间），器的值（定时时间），器的值（定时时间），器的值（定时时间），并进行自动减并进行自动减并进行自动减并进行自动减1 1操作。操作。操作。操作。定时周期寄存器定时周期寄存器定时周期寄存器定时周期寄存器PRDPRD 1616位的存储器映像寄存器位的存储器映像寄存器位的存储器映像寄存器位的存储器映像寄存器，位于数据
10、存储空间的，位于数据存储空间的，位于数据存储空间的，位于数据存储空间的00250025HH单单单单元，用来存放定时时间常数。每次复位或元，用来存放定时时间常数。每次复位或元，用来存放定时时间常数。每次复位或元，用来存放定时时间常数。每次复位或TINTTINT中断时，将定中断时，将定中断时，将定中断时，将定时时间装入时时间装入时时间装入时时间装入TIMTIM寄存器。寄存器。寄存器。寄存器。第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的
11、硬件结构的硬件结构2 2 2 2定时器定时器定时器定时器 定时控制寄存器定时控制寄存器定时控制寄存器定时控制寄存器TCRTCR 1616位的存储器映像寄存器，位于数据存储空间的位的存储器映像寄存器，位于数据存储空间的位的存储器映像寄存器，位于数据存储空间的位的存储器映像寄存器，位于数据存储空间的00260026HH单元，用来存储定时器的控制位和状态位单元，用来存储定时器的控制位和状态位单元，用来存储定时器的控制位和状态位单元，用来存储定时器的控制位和状态位，包括定时器分频，包括定时器分频，包括定时器分频，包括定时器分频系数系数系数系数TDDRTDDR、预标定计数器预标定计数器预标定计数器预标定
12、计数器PSCPSC、控制位控制位控制位控制位TRBTRB和和和和TSSTSS等。等。等。等。定时中断的周期：定时中断的周期：定时中断的周期：定时中断的周期：CLKOUTCLKOUT（TDDRTDDR1 1）（PRDPRD1 1）时钟周期时钟周期 分频系数分频系数定时周期定时周期第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构3 3 3 3时钟发生器时钟发生器时钟发生器时钟发生器 主主主主要要要要用用用用来来来来为为为
13、为CPUCPU提提提提供供供供时时时时钟钟钟钟信信信信号号号号，由由由由内内内内部部部部振振振振荡荡荡荡器器器器和和和和锁锁锁锁相相相相环环环环（PLLPLL）电电电电路路路路两两两两部部部部分分分分组组组组成成成成。可可可可通通通通过过过过内内内内部部部部的的的的晶晶晶晶振振振振或外部的时钟源驱动。或外部的时钟源驱动。或外部的时钟源驱动。或外部的时钟源驱动。锁相环电路锁相环电路锁相环电路锁相环电路具有频率放大和信号提纯的功能，利具有频率放大和信号提纯的功能，利具有频率放大和信号提纯的功能，利具有频率放大和信号提纯的功能，利用用用用PLLPLL的特性，可以锁定时钟发生器的振荡频率，为的特性，可
14、以锁定时钟发生器的振荡频率，为的特性，可以锁定时钟发生器的振荡频率，为的特性，可以锁定时钟发生器的振荡频率，为系统提供高稳定的时钟频率。系统提供高稳定的时钟频率。系统提供高稳定的时钟频率。系统提供高稳定的时钟频率。锁相环锁相环锁相环锁相环能使时钟源乘上一个特定的系数，得到一能使时钟源乘上一个特定的系数，得到一能使时钟源乘上一个特定的系数，得到一能使时钟源乘上一个特定的系数，得到一个比内部个比内部个比内部个比内部CPUCPU时钟频率低的时钟源。时钟频率低的时钟源。时钟频率低的时钟源。时钟频率低的时钟源。2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 第第第第
15、第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构 C54xC54x串行口的配置串行口的配置串行口的配置串行口的配置 芯片型号芯片型号SPSPBSPBSP McBSPMcBSP TMDTMD 芯片型号芯片型号 SPSPBSPBSP McBSPMcBSP TMDTMDC5412000C5490201C5420101C54020020C5430101C54090030C5451100C54100030C5461100C541600
16、30C5480201C54200060第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构5 5 5 5串行通信接口串行通信接口串行通信接口串行通信接口 （1 1 1 1）标准同步串行口标准同步串行口标准同步串行口标准同步串行口SPSP SPSP是是是是一一一一个个个个高高高高速速速速、全全全全双双双双工工工工、双双双双缓缓缓缓冲冲冲冲的的的的串串串串行行行行口口口口，提提提提供供供供了了了了与与与与编编编编码码码码器器
17、器器、A/DA/D转转转转换换换换器器器器等等等等串串串串行行行行设设设设备备备备之之之之间间间间的的的的通通通通信信信信，可可可可实实实实现现现现数数数数据据据据的的的的同同同同步发送和接收，能完成步发送和接收，能完成步发送和接收，能完成步发送和接收，能完成8 8 8 8位字节或位字节或位字节或位字节或16161616位字的串行通信。位字的串行通信。位字的串行通信。位字的串行通信。每每每每个个个个串串串串行行行行口口口口都都都都含含含含有有有有发发发发送送送送数数数数据据据据寄寄寄寄存存存存器器器器DXRDXR、发发发发送送送送移移移移位位位位寄寄寄寄存存存存器器器器XSRXSR、接接接接收
18、收收收数数数数据据据据寄寄寄寄存存存存器器器器DRRDRR和和和和接接接接收收收收移移移移位位位位寄寄寄寄存存存存器器器器RSRRSR，并并并并能能能能以以以以1/41/4机器周期频率工作。机器周期频率工作。机器周期频率工作。机器周期频率工作。在在在在进进进进行行行行数数数数据据据据的的的的接接接接收收收收和和和和发发发发送送送送时时时时，串串串串行行行行口口口口能能能能产产产产生生生生可可可可屏屏屏屏蔽蔽蔽蔽的的的的收收收收、发发发发中中中中断断断断（RINTRINT和和和和XINTXINT），通通通通过过过过软软软软件件件件来来来来管管管管理理理理数数数数据据据据的的的的接接接接收收收收和
19、和和和发发发发送。整个过程由串行口控制寄存器送。整个过程由串行口控制寄存器送。整个过程由串行口控制寄存器送。整个过程由串行口控制寄存器SPCSPC控制。控制。控制。控制。第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构5 5 5 5串行通信接口串行通信接口串行通信接口串行通信接口 （2 2 2 2）缓缓缓缓冲同步串行口冲同步串行口冲同步串行口冲同步串行口BSPBSP BSPBSP是是是是一一一一种种种种增增增增强强强
20、强型型型型同同同同步步步步串串串串行行行行口口口口，它它它它是是是是在在在在同同同同步步步步串串串串行行行行口口口口的的的的基基基基础础础础上增加了一个自动缓冲单元上增加了一个自动缓冲单元上增加了一个自动缓冲单元上增加了一个自动缓冲单元ABUABU。ABUABU的的的的功功功功能能能能：利利利利用用用用专专专专用用用用总总总总线线线线，控控控控制制制制串串串串行行行行口口口口直直直直接接接接与与与与 C54xC54x的的的的内部存储器进行数据交换。内部存储器进行数据交换。内部存储器进行数据交换。内部存储器进行数据交换。工作方式：非缓冲模式和自动缓冲模式。工作方式：非缓冲模式和自动缓冲模式。工作
21、方式：非缓冲模式和自动缓冲模式。工作方式：非缓冲模式和自动缓冲模式。非缓冲模式：即标准模式，与非缓冲模式：即标准模式，与非缓冲模式：即标准模式，与非缓冲模式：即标准模式，与SPSP相同。相同。相同。相同。自动缓冲模式：在自动缓冲模式：在自动缓冲模式：在自动缓冲模式：在ABUABU的控制下，串行口直接与的控制下，串行口直接与的控制下，串行口直接与的控制下，串行口直接与C54xC54x的的的的内部存储器进行内部存储器进行内部存储器进行内部存储器进行1616位数据块传输。当传输的数据长度是数据位数据块传输。当传输的数据长度是数据位数据块传输。当传输的数据长度是数据位数据块传输。当传输的数据长度是数据
22、块长度的一半或整个长度时，产生中断。块长度的一半或整个长度时，产生中断。块长度的一半或整个长度时，产生中断。块长度的一半或整个长度时，产生中断。这两种工作模式都提供了包括可编程控制的串口时钟、帧这两种工作模式都提供了包括可编程控制的串口时钟、帧这两种工作模式都提供了包括可编程控制的串口时钟、帧这两种工作模式都提供了包括可编程控制的串口时钟、帧同步信号、可选择时钟和帧同步信号的正负极性等增强功能，同步信号、可选择时钟和帧同步信号的正负极性等增强功能，同步信号、可选择时钟和帧同步信号的正负极性等增强功能，同步信号、可选择时钟和帧同步信号的正负极性等增强功能，能以每帧能以每帧能以每帧能以每帧8 8位
23、、位、位、位、1010位、位、位、位、1212位和位和位和位和1616位传输数据，最大操作频率为位传输数据，最大操作频率为位传输数据，最大操作频率为位传输数据，最大操作频率为CLKOUTCLKOUT。第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构5 5 5 5串行通信接口串行通信接口串行通信接口串行通信接口 （4 4 4 4）多路缓冲串行口多路缓冲串行口多路缓冲串行口多路缓冲串行口McBSPMcBSP McBSPM
24、cBSP是是是是一一一一个个个个高高高高速速速速、全全全全双双双双工工工工、多多多多通通通通道道道道缓缓缓缓冲冲冲冲串串串串行行行行接接接接口口口口，可可可可直接与其他直接与其他直接与其他直接与其他 C54xC54x、编码器以及系统中的其他串口器件通信。编码器以及系统中的其他串口器件通信。编码器以及系统中的其他串口器件通信。编码器以及系统中的其他串口器件通信。McBSPMcBSP提提提提供供供供了了了了全全全全双双双双工工工工通通通通信信信信、连连连连续续续续数数数数据据据据流流流流的的的的双双双双缓缓缓缓冲冲冲冲数数数数据据据据寄寄寄寄存存存存器器器器、接接接接收收收收和和和和发发发发送送送
25、送独独独独立立立立的的的的帧帧帧帧和和和和时时时时钟钟钟钟信信信信号号号号，可可可可以以以以直直直直接接接接与与与与T1/E1T1/E1帧帧帧帧接口。接口。接口。接口。McBSPMcBSP在在在在外外外外部部部部通通通通道道道道选选选选择择择择电电电电路路路路的的的的控控控控制制制制下下下下，采采采采用用用用分分分分时时时时的的的的方方方方式式式式实实实实现现现现多多多多通通通通道道道道串串串串行行行行通通通通信信信信，与与与与以以以以前前前前的的的的串串串串行行行行口口口口相相相相比比比比，具具具具有有有有很很很很大大大大的的的的灵灵灵灵活性。活性。活性。活性。第第第第第第2 2 2 2 2
26、 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构5 5 5 5串行通信接口串行通信接口串行通信接口串行通信接口 McBSPMcBSP的主要特点：的主要特点：的主要特点：的主要特点：串行口的接收、串行口的接收、串行口的接收、串行口的接收、发发发发送送送送时钟时钟时钟时钟既可由外部既可由外部既可由外部既可由外部设备设备设备设备提供，又可提供，又可提供，又可提供，又可由由由由 内部时钟提供；内部时钟提供；内部时钟提供；内部时钟提供；帧同步信号和时钟信号
27、的极性可编程；帧同步信号和时钟信号的极性可编程；帧同步信号和时钟信号的极性可编程；帧同步信号和时钟信号的极性可编程；信号的发送和接收既可单独运行，也可结合在一起配合信号的发送和接收既可单独运行，也可结合在一起配合信号的发送和接收既可单独运行，也可结合在一起配合信号的发送和接收既可单独运行，也可结合在一起配合 工作；工作；工作；工作；McBSPMcBSP的串行口可由的串行口可由的串行口可由的串行口可由CPUCPU控制运行，也可以脱离控制运行，也可以脱离控制运行，也可以脱离控制运行，也可以脱离CPUCPU 通过直接内存的读取操作来单独运行；通过直接内存的读取操作来单独运行；通过直接内存的读取操作来
28、单独运行；通过直接内存的读取操作来单独运行；具有多通道通信能力，可达具有多通道通信能力，可达具有多通道通信能力，可达具有多通道通信能力，可达128128128128个通道；个通道；个通道；个通道；数据的宽度可在数据的宽度可在数据的宽度可在数据的宽度可在8 8 8 8、12121212、16161616、20202020、24242424和和和和32323232位中选择，并位中选择，并位中选择，并位中选择，并 可对数据进行可对数据进行可对数据进行可对数据进行A A A A律和律和律和律和 律压缩和扩展。律压缩和扩展。律压缩和扩展。律压缩和扩展。第第第第第第2 2 2 2 2 2章章章章章章 TM
29、S320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构6 6 6 6软件可编程等待状态发生器软件可编程等待状态发生器软件可编程等待状态发生器软件可编程等待状态发生器 2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 功功功功能能能能：通通通通过过过过软软软软件件件件设设设设置置置置，完完完完成成成成外外外外部部部部总总总总线线线线周周周周期期期期的的的的扩扩扩扩展展展展，从从从从而而而而方方方方便便便便地地地地实实实实现现现现 C54xC
30、54x芯芯芯芯片片片片与与与与慢慢慢慢速速速速的的的的外外外外部部部部存存存存储储储储器器器器和和和和I/OI/O设备设备设备设备的接口。的接口。的接口。的接口。在在在在访访访访问问问问外外外外部部部部存存存存储储储储器器器器时时时时，软软软软件件件件等等等等待待待待状状状状态态态态寄寄寄寄存存存存器器器器（SWWSRSWWSR）可可可可为为为为每每每每3232KK字字字字的的的的程程程程序序序序、数数数数据据据据存存存存储储储储单单单单元元元元块块块块和和和和6464KK字的字的字的字的I/OI/O空间确定空间确定空间确定空间确定014014个等待状态。个等待状态。个等待状态。个等待状态。第
31、第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构的硬件结构7 7 7 7可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑 2.6C54x2.6C54x的片内外设电路的片内外设电路的片内外设电路的片内外设电路 可编程分区转换逻辑也称为可编程分区转换逻辑也称为可编程分区转换逻辑也称为可编程分区转换逻辑也称为可编程存储器转换逻辑可编程存储器转换逻辑可编程存储器转换逻辑可编程存储器转换逻辑。当当当当访访访访问问问
32、问过过过过程程程程跨跨跨跨越越越越程程程程序序序序或或或或数数数数据据据据存存存存储储储储器器器器边边边边界界界界时时时时，可可可可编编编编程程程程分分分分区区区区转换逻辑会自动转换逻辑会自动转换逻辑会自动转换逻辑会自动插入一个周期插入一个周期插入一个周期插入一个周期。当当当当存存存存储储储储过过过过程程程程由由由由程程程程序序序序存存存存储储储储器器器器转转转转向向向向数数数数据据据据存存存存储储储储器器器器时时时时，也也也也会会会会插插插插入入入入一个周期。一个周期。一个周期。一个周期。附附附附加加加加周周周周期期期期可可可可以以以以使使使使存存存存储储储储器器器器在在在在其其其其他他他他
33、器器器器件件件件驱驱驱驱动动动动总总总总线线线线之之之之前前前前允允允允许许许许存存存存储器释放总线，以避免总线竞争。储器释放总线，以避免总线竞争。储器释放总线，以避免总线竞争。储器释放总线，以避免总线竞争。转换的存储块的大小由存储器转换寄存器（转换的存储块的大小由存储器转换寄存器（转换的存储块的大小由存储器转换寄存器（转换的存储块的大小由存储器转换寄存器（BSCRBSCR）确定。确定。确定。确定。第第第第第第2 2 2 2 2 2章章章章章章 TMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54xTMS320C54x的硬件结构的硬件结构的硬件结构
34、的硬件结构的硬件结构的硬件结构7 7 7 7可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑可编程分区转换逻辑 分区转换逻辑分区转换逻辑自动插入等待周期自动插入等待周期的几种情况：的几种情况：一次程序存储器读操作之后，紧跟着不同存储器分区一次程序存储器读操作之后，紧跟着不同存储器分区的另一次程序存储器读或数据存储器读操作；的另一次程序存储器读或数据存储器读操作；当当PSDS位置位置1时，一次程序存储器读操作之后，紧时，一次程序存储器读操作之后，紧 跟着一次数据存储器读操作；跟着一次数据存储器读操作；对于对于C548或或C549，一次程序存储器读操作之后，一次程序存储器读操作之后，紧紧 跟着对不同页进行另一次程序存储器读操作；跟着对不同页进行另一次程序存储器读操作；一次数据存储器读操作之后，紧跟着对一个不同的存一次数据存储器读操作之后，紧跟着对一个不同的存储器分区进行另一次程序存储器或数据存储器读操作；储器分区进行另一次程序存储器或数据存储器读操作；当当PSDS位置位置1时，一次数据存储器读操作之后，紧时，一次数据存储器读操作之后，紧 跟着一次程序存储器读操作。跟着一次程序存储器读操作。