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1、数字逻辑电路课程思政优秀案例一、课程简介“数字逻辑电路”课程是电子信息与电气工程类专业的工程基 础课，提供数字技术和数字系统的基本概念、基本原理和基本技 能，学习数字电路的分析与设计方法，培养工程实践能力、创新精 神，以及工程师的使命与责任，同时为后续专业课程的学习以及适 应现代信息社会的快速变化奠定坚实的基础。案例一：时序逻辑电路的设计思政育人目标1 .培养高阶思维和计算思维；2 .培养学无止境、追求真理的精神。思政育人案例设计教学内容：1 .米里（Mealy）型与摩尔（Moore）型有限状态机的建立；2 .时序逻辑电路的设计方法。思政融入点：1. “111”序列检测器的传统设计方法首先根据
2、同步时序电路的设计步骤讲授基于Mealy型状态机的 “111”序列检测器的设计过程，然后设定时钟和输入，让学生画出 上述设计的“111”序列检测器的状态和输出波形，会发现输出波形 与预期的不一致。通过这个活动，引发学生认知冲突，激发学生思维碰撞，引导 学生批判性地思考问题，找到解决问题的答案。接着研讨：(1)如 何用Moore型状态机设计 何11”序列检测器? (2) Mealy型状态 机和Moore型状态机的区别。二金有限状态机(FSM)，米里(Mady)状态机/摩尔(Moore)状态机2. “111”序列检测器的Verilog HDL设计方法通过讨论，让学生明白可以用两种结构化的方法和一种
3、直接描 述状态机的方法设计“111”序列检测器，使学生理解用HDL描述状 态机的方法设计数字逻辑电路的优点，培养学生的计算思维。总结时序逻辑电路设计方法，让学生领会数字电路设计会存在 多种方案，要学会对不同方案进行评价，开展学生的高阶思维。在 此基础上，讲述钱学森“Nothing is final !”的故事，通过这个 故事培养学生学无止境、追求真理的科学精神。案例二：可编程逻辑器件的开展与应用思政育人目标1 .培养创新意识；2 .培养科技报国的使命担当。思政育人案例设计教学内容：1. PLD器件的开展历程；2. CPLD与FPGA的特点；3. FPGA的开发与应用。思政融入点：1 .可编程逻辑器件的开展从早期低密度的PLA,到后来的PAL和GAL,再到高密度的 EPLD和最新的CPLD；从FPGA概念的提出，到全球第一款FPGA产 品的推出，再到如今高性能的FPGA,揭示着一个道理：每一个看 来很成功的新事物，从诞生到开展壮大都不可防止地经历过艰难 的历程。2 .我国FPGA技术的开展通过我国FPGA技术开展过程，特别是具有自主知识产权的 FPGA水平，增强学生的民族自豪感。让学生了解我国FPGA技术在半导体工艺和宇航级抗辐射性能 上与兴旺国家的差距，提升学生科技报国的使命感。