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1、1：什么是同步逻辑和异步逻辑？（汉王）同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。答案应当与上面问题一致补充：同步时序逻辑电路的特点：各触发器的时钟端所有连接在一起，并接在系统时钟端，只有当时钟脉冲到来时，电路的状态才干改变。改变后的状态将一直保持到下一个时钟脉冲的到来，此时无论外部输入 x 有无变化，状态表中的每个状态都是稳定的。异步时序逻辑电路的特点：电路中除可以使用带时钟的触发器外，还可以使用不带时钟的触发器和延迟元件作为存储元件，电路中没有统一的时钟，电路状态的改变由外部输入的变化直接引起。2：同步电路和异步电路的区别：同步电路：存储电路中所有触发器的时
2、钟输入端都接同一个时钟脉冲源，因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。异步电路：电路没有统一的时钟，有些触发器的时钟输入端与时钟脉冲源相连，这有这些触发器的状态变化与时钟脉冲同步，而其他的触发器的状态变化不与时钟脉冲同步。3：时序设计的实质：电路设计的难点在时序设计，时序设计的实质就是满足每一个触发器的建立/保持时间的而规定。4：建立时间与保持时间的概念？建立时间：触发器在时钟上升沿到来之前，其数据输入端的数据必须保持不变的时间。保持时间：触发器在时钟上升沿到来之后，其数据输入端的数据必须保持不变的时间。不考虑时钟的skew，D2的建立时间不能大于（时钟周期T - D1数据最迟到
3、达时间T1max+T2max）；保持时间不能大于（D1数据最快到达时间T1min+T2min）；否则D2的数据将进入亚稳态并向后级电路传播5：为什么触发器要满足建立时间和保持时间？因为触发器内部数据的形成是需要一定的时间的，假如不满足建立和保持时间，触发器将进入亚稳态，进入亚稳态后触发器的输出将不稳定，在0和1之间变化，这时需要通过一个恢复时间，其输出才干稳定，但稳定后的值并不一定是你的输入值。这就是为什么要用两级触发器来同步异步输入信号。这样做可以防止由于异步输入信号对于本级时钟也许不满足建立保持时间而使本级触发器产生的亚稳态传播到后面逻辑中，导致亚稳态的传播。（比较容易理解的方式）换个方式
4、理解：需要建立时间是由于触发器的D段像一个锁存器在接受数据，为了稳定的设立前级门的状态需要一段稳定期间；需要保持时间是由于在时钟沿到来之后，触发器要通过反馈来所存状态，从后级门传到前级门需要时间。6：什么是亚稳态？为什么两级触发器可以防止亚稳态传播？这也是一个异步电路同步化的问题，具体的可以参考EDACN技术月刊20230401。亚稳态是指触发器无法在某个规定的时间段内到达一个可以确认的状态。使用两级触发器来使异步电路同步化的电路其实叫做“一步同位器”，他只能用来对一位异步信号进行同步。两级触发器可防止亚稳态传播的原理：假设第一级触发器的输入不满足其建立保持时间，它在第一个脉冲沿到来后输出的数
5、据就为亚稳态，那么在下一个脉冲沿到来之前，其输出的亚稳态数据在一段恢复时间后必须稳定下来，并且稳定的数据必须满足第二级触发器的建立时间，假如都满足了，在下一个脉冲沿到来时，第二级触发器将不会出现亚稳态，由于其输入端的数据满足其建立保持时间。同步器有效的条件：第一级触发器进入亚稳态后的恢复时间 + 第二级触发器的建立时间 carryout = 0;next_state carryout = 1;next_state carryout = 1;next_state carryout = 0;next_state carryout = 1;next_state carryout = 0;next_state carryout = 0;next_state carryout = 1;next_state carryout = X;next_state = X;end case;end process;