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1、精选学习资料 - - - - - - - - - 本科生期末试卷(一)一、挑选题(每道题 2 分,共 30 分)1 从器件角度看,运算机经受了五代变化;但从系统结构看,至今绝大多数运算机仍属于(b )运算机; A 并行 B 冯 诺依曼 C 智能 D 串行2 某机字长 32 位,其中 1 位表示符号位;如用定点整数表示,就最小负整数为(A ); A -2 31-1 B -2 30-1 C -2 31+1 D -2 30+1 3 以下有关运算器的描述,(c )是正确的;A 只做加法运算 B 只做算术运算C 算术运算与规律运算 D 只做规律运算4 EEPROM是指( d ); A 读写储备器 B 只
2、读储备器 C 闪速储备器 D 电擦除可编程只读储备器5 常用的虚拟储备系统由(b )两级储备器组成,其中辅存是大容量的磁表面储备器;存6 A cache- 主存 B 主存 - 辅存 C cache- 辅 D 通用寄存器 -cache c ); RISC 访内指令中,操作数的物理位置一般支配在(A 栈顶和次栈顶C B 两个主存单元一个主存单元和一个通用寄存器1 / 5 名师归纳总结 - - - - - - -第 1 页,共 5 页精选学习资料 - - - - - - - - - D 两个通用寄存器7 当前的 CPU由(b )组成;A 掌握器 B 掌握器、运算器、 cache C 运算器、主存 D
3、 掌握器、 ALU、主存8 流水 CPU是由一系列叫做“ 段” 的处理部件组成;和具备 m个并行部件的 CPU相比,一个 m段流水 CPU的吞吐才能是(a );A 具备同等水平 B 不具备同等水平C 小于前者 D 大于前者9 在集中式总线仲裁中,(a )方式响应时间最快; A 独立恳求 B 计数器定时查询 C 菊花链10 CPU中跟踪指令后继地址的寄存器是(a ); A 地址寄存器 B 指令计数器 C 程序计数器 D 指令寄存器11 从信息流的传输速度来看,(a )系统工作效率最低; A 单总线 B 双总线 C 三总线 D 多总线12 单级中断系统中, CPU一旦响应中断,立刻关闭(c )标志
4、,以防止本次中断服务终止前同级的其他中断源产生另一次中断进行干扰; A 中断答应 B 中断恳求 C 中断屏蔽 D DMA恳求2 / 5 名师归纳总结 - - - - - - -第 2 页,共 5 页精选学习资料 - - - - - - - - - 13安腾处理机的典型指令格式为(d )位; A 32 位 B 64 位 C 41 位 D 48 位14 下面操作中应当由特权指令完成的是(b );A 设置定时器的初值 B 从用户模式切换到治理员模式C 开定时器中断 D 关中断15 以下各项中,不属于安腾体系结构基本特点的是(c );A 超长指令字 B 显式并行指令运算C 推断执行 D 超线程二、简答
5、题(每道题 8 分,共 16 分)1 假设主存容量 16M 32 位, Cache容量 64K 32 位,主存与 Cache之间以每块 4 32 位大小传送数据,请确定直接映射方式的有关参数,并画出内存地址格式;2指令和数据都用二进制代码存放在内存中,从时空观角度回答CPU如何区分读出的代码是指令仍是数据;三、运算题( 14 分)设 x=-18,y=+26,数据用补码表示,用带求补器的阵列乘法器求出乘积 x y,并用十进制数乘法进行验证;四、证明题( 12 分)用定量分析方法证明多模块交叉储备器带宽大于次序储备器带宽;五、分析题( 12 分)3 / 5 名师归纳总结 - - - - - - -
6、第 3 页,共 5 页精选学习资料 - - - - - - - - - 图 1 所示的系统中, A、B、C、D四个设备构成单级中断结构,它要求 CPU 在执行完当前指令时转向对中断恳求进行服务;现假设: T DC为查询链中每个设备的推迟时间; T A、TB、TC、TD分别为设备 A、B、C、D的服务程序所需的执行时间; TS、TR分别为储存现场和复原现场所需的时间; 主存工作周期为 TM; 中断批准机构在确认一个新中断之前,先要让即将被中断的程序的一条指令执行完毕;试问:在确保恳求服务的四个设备都不会丢失信息的条件下,中断饱和的最小时间是多少?中断极限频率是多少?六、设计题( 16 分)某运算
7、机有图 2 所示的功能部件,其中M为主存,指令和数据均存放在其中, MDR为主存数据寄存器, MAR为主存地址寄存器, R0R3为通用寄存器, IR为指令寄存器, PC为程序计数器(具有自动加1 功能), C、D为暂存寄存器,ALU为算术规律单元,移位器可左移、右移、直通传送;1 将全部功能部件连接起来,组成完整的数据通路,并用单向或双向箭头表示信息传送方向;2 画出“ADD R1,( R2)” 指令周期流程图;该指令的含义是将 R1 中的数与( R2)指示的主存单元中的数相加,相加的结果直通传送至 R1中;3 如另外增加一个指令存贮器,修改数据通路,画出的指令周期流程图;4 / 5 名师归纳总结 - - - - - - -第 4 页,共 5 页精选学习资料 - - - - - - - - - 5 / 5 名师归纳总结 - - - - - - -第 5 页,共 5 页