《2022年电子工程师面试题库.docx》由会员分享，可在线阅读，更多相关《2022年电子工程师面试题库.docx（73页珍藏版）》请在taowenge.com淘文阁网|工程机械CAD图纸|机械工程制图|CAD装配图下载|SolidWorks_CaTia_CAD_UG_PROE_设计图分享下载上搜索。
1、精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆部分电子工程师面试题模拟、模拟电路（ Analog Circuit ）：处理模拟信号的电子电路 模拟信 号：时间和幅度都连续的信号 （连续的含义是在某以取值范畴那可以 取无穷多个数值）；数字、数字信号指幅度的取值是离散的,幅值表 示被限制在有限个数值之内； 二进制码就是一种数字信号； 二进制码 受噪声的影响小,易于有数字电路进行处理, 所以得到了广泛的应用；CMOS（Complementary Metal Oxide Semiconductor）,互补金属氧化物半导体,电压掌握的一种放大器件；是组成CMOS 数字集成电
2、路的基本单元； MCUMicroControllerUnit 中文名称为微掌握单元,又 称单片微型运算机 SingleChipMicrocomputer或者单片机,是指随着大规模集成电路的显现及其进展,将运算机的CPU、RAM 、ROM、定时数器和多种 I/O 接口集成在一片芯片上,形成芯片级的运算机,为不同的应用场合做不同组合掌握；RISC（reduced instruction set computer,精简指令集运算机）是一种执行较少类型运算机指令的微处理器,起源于（即 RISC 机）,RISC 机中采纳的微处理器统称80 岁月的 MIPS 主机 RISC 处理器；这样一来,它能够以更快
3、的速度执行操作（每秒执行更多百万条指令,即 MIPS）；由于运算机执行每个指令类型都需要额外的晶体管和电路元 件,运算机指令集越大就会使微处理器更复杂,执行操作也会更慢；名师归纳总结 - - - - - - -第 1 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆CISC、DSP、ASIC、FPGA ASIC:专用集成电路,它是面对特地用途的电路,特地为一个用户设 计和制造的；依据一个用户的特定要求,能以低研制成本,短、交货 周 期 供 货 的 全 定 制 , 半 定 制 集 成 电 路 ； 与 门 阵 列 等 其 它 ASICApplicatio
4、n Specific IC 相比,它们又具有设计开发周期短、设 计制造成本低、开发工具先进、标准产品无需测试、质量稳固以及可 实时在线检验等优点3、基尔霍夫定律的内容是什么？（仕兰微电子）基尔霍夫定律（ Kirchhoff Law ）基尔霍夫电流定律（KCL ）： 对任一集总参数电路中的任一节点,在任一瞬时,流出该节点的全部电流的代数和恒为零；基尔霍夫电压定律 （KVL ）： 对任一集总参数电路中的任一回路,在 任一瞬时,沿此回路的各段电压的代数和恒为零；4、平板电容公式 C= S/4 kd 5、三极管曲线特性；（未知）6、描述反馈电路的概念,列举他们的应用；（仕兰微电子）名师归纳总结 反馈是
5、将放大器输出信号电压或电流 的一部分或全部 ,回授到放大第 2 页,共 45 页- - - - - - -精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆器输入端与输入信号进行比较相加或相减 ,并用比较所得的有效输入信号去掌握输出 ,这就是放大器的反馈过程 .凡是回授到放大器输入端的反馈信号起加强输入原输入信号的,使输入信号增加的称正反馈.反之就反 .按其电路结构又分为:电流反馈电路和电压反馈电路.正反馈电路多应用在电子振荡电路上,而负反馈电路就多应用在各种高低频放大电路上 .因应用较广 ,所以我们在这里就负反馈电路加以论述 .负反馈对放大器性能有四种影响 : 1.
6、 负反馈能提高放大器增益的稳固性. （温度稳固性）2.负反馈能使放大器的通频带展宽 . 3.负反馈能削减放大器的失真 . 4.负反馈能提高放大器的信噪比 . 5.负反馈对放大器的输出输入电阻有影响；7、负反馈种类电压并联反馈,电流串联反馈,电压串联反馈和电流并联反馈8、放大电路的频率补偿的目的是什么,有哪些方法？（仕兰微电子）补偿后的波特图；（凹凸）频率补偿是采纳肯定的手段转变集成运放的频率响应,产生相位和频名师归纳总结 - - - - - - -第 3 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆率差的排除；使反馈系统稳固的主要方法就是频率补偿
7、 . 常用的方法是在基本电路或反馈网络中添加一些元件来转变反馈放大电路的开环频率特性主要是把高频时最小极点频率与其相近的极点频率的间距拉大 ,破坏自激振荡条件 ,经保证闭环稳固工作 ,并满意 要求的稳固裕度 ,实际工作中常采纳的方法是在基本放大器中接入由 电容或 RC 元件组成的补偿电路 ,来消去自激振荡 . 9、怎样的频率响应算是稳固的,如何转变频响曲线；（未知）右半平面无极点,虚轴无二阶以上极点；10、基本放大电路种类,优缺点,特殊是广泛采纳差分结构的缘由；（未知）共射放大电路 具有较高的放大倍数；输入和输出信号相位相反；输入电阻不高；输出电阻取决于Rc 的数值；如要减小输出电阻,需要减小
8、Rc 的阻值,这将影响电路的放大倍数； 共集电极电路名师归纳总结 - - - - - - -第 4 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆电压放大倍数小于 1；输入和输出信号同相；输入电阻较高,信号源内阻不很低时仍可猎取较大输入信号；输出电阻较小,所以带负载才能较强；因此,它多用于输入级或输出 级；对由于衬底耦合产生的输入共模噪声有着抑制作用11、给出一差分电路, 告知其输出电压 Y+和 Y-,求共模重量和差模分 量；（未知）11、画差放的两个输入管； （凹凸）12、画出由运放构成加法、减法、微分、积分运算的电路原理图；并 画出一个晶体管级
9、的运放电路； （仕兰微电子）13、用运算放大器组成一个10 倍的放大器；（未知）14、给出一个简洁电路, 让你分析输出电压的特性 （就是个积分电路）,并求输出端某点的 rise/fall 时间； Infineon 笔试试题 15、电阻 R 和电容 C 串联,输入电压为R 和 C 之间的电压,输出电压分别为 C 上电压和 R 上电压,要求绘制这两种电路输入电压的频 谱,判定这两种电路名师归纳总结 - - - - - - -第 5 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆8、给出一个差分运放,如何相位补偿,并画补为高通滤波器,何为低通滤波器；当
10、RC16、有源滤波器和无源滤波器的原理及区分 .（新太硬件）17、有一时域信号S=V0sin2pif0t+V1cos2pif1t+V2sin2pif3t+90,当其通过低通、带通、高通滤波器后的信号表示方式；（未知）18、挑选电阻时要考虑什么？（东信笔试题）19、在 CMOS 电路中,要有一个单管作为开关管精确传递模拟低电平,这个单管你会用P 管仍是 N 管,为什么？（仕兰微电子）20、给出多个 mos 管组成的电路求 5 个点的电压；Infineon 笔试试题 21、电压源、电流源是集成电路中常常用到的模块,请画出你知道的线路结构,简洁描述其优缺点； （仕兰微电子）22、画电流偏置的产生电路
11、,并说明； （凹凸）23、史密斯特电路 ,求回差电压；（华为面试题）24、晶体振荡器 ,似乎是给出振荡频率让你求周期 分之一周期 . （华为面试题）应当是单片机的 ,12名师归纳总结 - - - - - - -第 6 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆25、LC 正弦波振荡器有哪几种三点式振荡电路,（仕兰微电子）分别画出其原理图；26、VCO 是什么 ,什么参数 压控振荡器 . （华为面试题）27、锁相环有哪几部分组成？（仕兰微电子）28、锁相环电路组成,振荡器（比如用D 触发器如何搭）；（未知）29、求锁相环的输出频率,给了一个锁相环
12、的结构图；（未知）30、假如公司做高频电子的,可能仍要 类,不一一列举；（未知）31、一电源和一段传输线相连（长度为RF 学问,调频,鉴频鉴相之L,传输时间为 T）,画出终端处波形,考虑传输线无损耗；给出电源电压波形图,要求绘制终端波 形图；（未知）32、微波电路的匹配电阻； （未知）33、DAC 和 ADC 的实现各有哪些方法？（仕兰微电子）名师归纳总结 - - - - - - -第 7 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆34、A/D 电路组成、工作原理； （未知）35、实际工作所需要的一些技术学问面试简洁问到 ；如电路的低功耗,稳固
13、,高速如何做到,调运放,布版图留意的地方等等 ,一般会针对简历上你所写做过的东西具体问,么都写上,熟知之类的词也别用太多了）了,不好说什么了；（未知）数字电路确定会问得很细 （所以别把什,这个东西各个人就不一样1、同步电路和异步电路的区分是什么？（仕兰微电子）2、什么是同步规律和异步规律？（汉王笔试）同步规律是时钟之间有固定的因果关系；固定的因果关系；异步规律是各时钟之间没有3、什么是 线与 规律,要实现它,在硬件特性上有什么具体要求？（汉王笔试）线与规律是两个输出信号相连可以实现与的功能；在硬件上,要用oc 门来实现,由于不用 oc 门可能使灌电流过大,而烧坏规律门；同时在输出端口应加一个上
14、拉电阻；名师归纳总结 - - - - - - -第 8 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆4、什么是 Setup 和 Holdup 时间？（汉王笔试）5、setup和 holdup 时间,区分.（南山之桥）6、说明 setup time 和 hold time 的定义和在时钟信号推迟时的变化；（未知）7、说明 setup和 hold time violation ,画图说明,并说明解决方法；（威盛 VIA2003.11.06 上海笔试试题）入信号和时钟信号之间的时间要求；Setup/hold time 是测试芯片对输 建立时间是指触发器
15、的时钟信号上升沿到来以前, 数据稳固不变的时间； 输入信号应提前时钟上升沿（如上升沿有效） T 时间到达芯片,这个T 就是建立时间 -Setup time.如不满意 setup time,这个数据就不能被这一时钟打入触发器,只有在 下一个时钟上升沿, 数据才能被打入触发器； 保持时间是指触发器的 时钟信号上升沿到来以后,数据稳固不变的时间；假如 hold time 不够,数据同样不能被打入触发器；建立时间Setup Time和保持时间（Hold time）；建立时间是指在时钟边沿前,数据信号需要保持不变 的时间；保持时间是指时钟跳变边沿后数据信号需要保持不变的时间；假如不满意建立和保持时间的话
16、,那么 DFF 将不能正确地采样到数据, 将会显现 metastability 的 情形；假如数据信号在时钟沿触发前后连续的时间均超过建立和保持 时间,那么超过量就分别被称为建立时间裕量和保持时间裕量；名师归纳总结 - - - - - - -第 9 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆8、说说对数字规律中的竞争和冒险的懂得,并举例说明竞争和冒险 怎样排除；（仕兰微电子）9、什么是竞争与冒险现象？怎样判定？如何排除？（汉王笔试）在组合规律中,由于门的输入信号通路中经过了不同的延时,导致到达该门的时间不一样叫竞争；产生毛刺叫冒险； 假如布尔式
17、中有相反的信号就可能产生竞争和冒险现象；解决方法：一是添加布尔式的消去项,二是在芯片外部加电容；10、你知道那些常用规律电平？（汉王笔试）TTL 与 COMS 电平可以直接互连吗？常用规律电平： 12V,5V,3.3V；TTL 和 CMOS 不行以直接 互连,由于 TTL 是在 0.3-3.6V 之间,而 CMOS 就是有在 12V 的有在 5V 的；CMOS 输出接到 TTL 是可以直接互连； TTL 接 CMOS 需要 在输出端口加一上拉电阻接到 5V 或者 12V；11、如何解决亚稳态；（飞利浦大唐笔试）亚稳态是指触发器无法在某个规定时间段内达到一个可确认 的状态；当一个触发器进入亚稳态
18、时, 既无法猜测该单元的输出电平,也无法猜测何时输出才能稳固在某个正确的电平上；在这个稳固期 间,触发器输出一些中间级电平,或者可能处于振荡状态,并且这种 无用的输出电平可以沿信号通道上的各个触发器级联式传播下去；名师归纳总结 - - - - - - -第 10 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆12、IC 设计中同步复位与异步复位的区分；（南山之桥）13、MOORE 与 MEELEY 状态机的特点；（南山之桥）14、多时域设计中 ,如何处理信号跨时域； （南山之桥）15、给了 reg 的 setup,hold时间,求中间组合规律的 d
19、elay 范畴；（飞利浦大唐笔试） Delay q,仍有 clock的 delay,写出打算最大时钟的因素,同时给出表达式；（威盛VIA 2003.11.06 上海笔试试题）18、说说静态、动态时序模拟的优缺点； （威盛 VIA 2003.11.06 上海笔试试题）19、一个四级的Mux,其中其次级信号为关键信号如何改善 timing；（威盛 VIA 2003.11.06 上海笔试试题）名师归纳总结 - - - - - - -第 11 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆20、给出一个门级的图,又给了各个门的传输延时,问关键路径是什么,仍
20、问给出输入,使得输出依靠于关键路径；（未知）21、规律方面数字电路的卡诺图化简,时序（同步异步差异）,触发器有几种（区分,优点） ,全加器等等；（未知）22、卡诺图写出规律表达使； （威盛 VIA 2003.11.06 上海笔试试题）23、化简 FA,B,C,D= m1,3,4,5,10,11,12,13,14,15的和；（威盛）24、 please show the CMOS inverter schmatic,layout and its cross sectionwith P-well process.Plot its transfer curve Vout-Vin And also e
21、xplain the operation region of PMOS and NMOS for each segment of the transfer curve. （威盛笔试题 circuit design-beijing-03.11.09）25、To design a CMOS invertor with balance rise and fall time,please define the ration of channel width of PMOS and NMOS and explain. 26、为什么一个标准的倒相器中P管的宽长比要比N 管的宽长比大？（仕兰微电子）名师归纳
22、总结 - - - - - - -第 12 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆unCox W/L. 27、用 mos 管搭出一个二输入与非门； （扬智电子笔试）28、please draw the transistor level schematic of a cmos 2 input AND gate and explain which input has faster response for output rising edge.less delay time；（威盛笔试题 circuit design-beijing-03.11.
23、09）29、画出 NOT,NAND,NOR 的符号,真值表,仍有 transistor level 的电路；（Infineon 笔试）30、画出 CMOS 的图,画出 tow-to-one mux gate；（威盛 VIA 2003.11.06 上海笔试试题）31、用一个二选一 mux 和一个 inv 实现异或；（飞利浦大唐笔试）32、画出 Y=A*B+C 的 cmos电路图；（科广试题）33、用规律们和 cmos 电路实现 ab+cd；（飞利浦大唐笔试）名师归纳总结 - - - - - - -第 13 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就
24、殆34、画出 CMOS 电路的晶体管级电路图, 实现 Y=A*B+CD+E ；（仕兰微电子）35、利用 4 选 1 实现 Fx,y,z=xz+yz；（未知）36、给一个表达式f=xxxx+xxxx+xxxxx+xxxx用最少数量的与非门实现（实际上就是化简） ；37、给出一个简洁的由多个 入波形画出各点波形；（Infineon 笔试）NOT,NAND,NOR 组成的原理图, 依据输38、为了实现规律（ A XOR B ）OR （C AND D ）,请选用以下规律中的一种,并说明为什么？ 1）INV 2）AND 3）OR 4）NAND 5）NOR 6）XOR 答案： NAND （未知）39、用与
25、非门等设计全加法器； （华为）40、给出两个门电路让你分析异同； （华为）41、用简洁电路实现,当A 为输入时,输出B 波形为 （仕兰微电子）42、A,B,C,D,E 进行投票,多数听从少数,输出是 F（也就是假如 A,B,C,D,E 中 1 的个数比 0 多,那么 F 输出为 1,否就 F 为 0）,用与 非门实现,输入数目没有限制； （未知）43、用波形表示 D 触发器的功能；（扬智电子笔试）44、用传输门和倒向器搭一个边沿触发器； （扬智电子笔试）名师归纳总结 - - - - - - -第 14 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆
26、45、用规律们画出 D 触发器；（威盛 VIA 2003.11.06 上海笔试试题）46、画出 DFF 的结构图 ,用 verilog 实现之；（威盛）47、画出一种 CMOS 的 D 锁存器的电路图和版图； （未知）48、D 触发器和 D 锁存器的区分；（新太硬件面试）49、简述 latch 和 filp-flop 的异同；（未知）50、LATCH 和 DFF 的概念和区分；（未知）51、latch与 register的区分 ,为什么现在多用 register.行为级描述中 latch 如何产生的；（南山之桥）52、用 D 触发器做个二分颦的电路.又问什么是状态图；（华为）53、请画出用 D
27、 触发器实现 2 倍分频的规律电路？（汉王笔试）54、怎样用 D 触发器、与或非门组成二分频电路？（东信笔试）55、How many flip-flop circuits are needed to divide by 16. Intel 16 分 频？56、用 filp-flop 和 logic-gate 设计一个 1 位加法器,输入 carryin 和 current-stage,输出 carryout 和 next-stage. （未知）57、用 D 触发器做个 4 进制的计数；（华为）58、实现 N 位 Johnson Counter,N=5；（南山之桥）59、用你熟识的设计方式设计一
28、个可预置初值的 15 进制的呢？（仕兰微电子）7 进制循环计数器,60、数字电路设计当然必问 Verilog/VHDL ,如设计计数器；（未知）61、BLOCKING NONBLOCKING 赋值的区分；（南山之桥）65、请用 HDL 描述四位的全加法器、 5 分频电路；（仕兰微电子）名师归纳总结 - - - - - - -第 15 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆66、用 VERILOG 或 VHDL 写一段代码,实现 知）10 进制计数器；（未67、用 VERILOG 或 VHDL 写一段代码,实现排除一个 glitch；（未知）
29、68、一个状态机的题目用verilog 实现（不过这个状态机画的实在比较差,很简洁误会的） ；（威盛 VIA 2003.11.06 上海笔试试题）69、描述一个交通信号灯的设计； （仕兰微电子）70、画状态机,接受1,2,5 分钱的卖报机,每份报纸5 分钱；（扬智电子笔试）71、设计一个自动售货机系统,卖soda 水的,只能投进三种硬币,要正确的找回钱数；（1）画出 fsm（有限状态机）；（2）用verilog 编程,语法要符合fpga 设计的要求；（未知）72、设计一个自动饮料售卖机,饮料 10 分钱,硬币有 5 分和 10 分两 种,并考虑找零：（1）画出 fsm（有限状态机）；（2）用
30、verilog 编程,语法要符合 fpga 设计 的要求；（3）设计工程中可使用的工具及设计大致过程；（未知）73、画出可以检测 10010 串的状态图 ,并 verilog 实现之；（威盛）74、用 FSM 实现 101101的序列检测模块；（南山之桥）a 为输入端, b 为输出端,假如 就为 0；a 连续输入为 1101 就 b 输出为 1,否例如 a： 0001100110110100100110 b： 0000000000100100000000 名师归纳总结 - - - - - - -第 16 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就
31、殆请画出 state machine；请用 RTL 描述其 state machine；（未知）78、sram,falsh memory,及 dram 的区分？（新太硬件面试）79、给出单管 DRAM 的原理图西电版数字电子技术基础 作者杨颂华、 冯毛官 205 页图 914b,问你有什么方法提高refresh time,总共有 5 个问题,记不起来了；（降低温度,增大电容储备容量） （Infineon 笔试）81、名词 :sram,ssram,sdram 名词 IRQ,BIOS,USB,VHDL,SDR IRQ: Interrupt ReQuest BIOS: Basic Input Out
32、put System USB: Universal Serial Bus VHDL: VHIC Hardware Description Language SDR: Single Data Rate 压控振荡器的英文缩写 VCO；DRAM ；动态随机储备器的英文缩写名词说明,无聊的外文缩写罢了,比如 pipeline、PCI、ECC、DDR、interrupt、IRQ,BIOS,USB,VHDL,VLSI VCO压控振荡器 RAM 动态随机储备器,FIR IIR DFT 离散名师归纳总结 - - - - - - -第 17 页,共 45 页精选学习资料 - - - - - - - - - 学而
33、不思就惘,思而不学就殆傅立叶变换 或者是中文的,比如： a.量化误差b.直方图 c.白平稳3、什么叫做 OTP 片OTP（一次性可编程） 、掩膜片,两者的区分 何在？（仕兰微面试题目）OTP 与掩膜 OTP 是一次性写入的单片机；过去认为一个单片机产品 的成熟是以投产掩膜型单片机为标志的；由于掩膜需要肯定的生产周期,而OTP 型单片机价格不断下降,使得近年来直接使用 OTP 完成最终产品制造更为流行； 它较之掩膜具有生产周期短、 风险小的特点； 近年来,OTP 型单片机需量大幅度上扬,为适 应 这 种 需 求 许 多 单 片 机 都 采 用 了 在 片 编 程 技 术 In System Pr
34、ogramming；未编程的 OTP 芯片可采纳裸片 Bonding 技术或表面贴技术, 先焊在印刷板上, 然后通过单片机上 引出的编程线、串行数据、时钟线等对单片机编程；解决了批量写OTP 芯片时简洁显现的芯片与写入器名师归纳总结 接触不好的问题；使OTP 的裸片得以广第 18 页,共 45 页- - - - - - -精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆泛使用,降低了产品的成本；编程线与 额外引脚；而一些生产厂商推出的单I/O 线共用,不增加单片机的片机不再有掩膜型,全部为有 ISP功能的 OTP；4、你知道的集成电路设计的表达方式有哪几种？（仕兰微
35、面试题目）5、描述你对集成电路设计流程的熟识； （仕兰微面试题目）一般来说 asic 和 fpga/cpld 没有关系！ fpga 是我们在小批量或者试验中采纳的,生活中的电子器件上很少见到的；而 asic 是通过掩膜得到的,它是不行被修改的；至于流程,应当是前端、综合、仿真、后端、检查、加工、测试、封装；6、简述 FPGA 等可编程规律器件设计流程； （仕兰微面试题目）通常可将 FPGA/CPLD 设计流程归纳为以下 计有相像之处；7 个步骤,这与 ASIC 设名师归纳总结 - - - - - - -第 19 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思
36、而不学就殆1.设计输入；在传统设计中,设计人员是应用传统的原理图输入方法来开头设计的；自 90 岁月初,Verilog、VHDL 、AHDL 等硬件描述语言的输入方法在大规模设计中得到了广泛应用；2.前仿真（功能仿真） ；设计的电路必需在布局布线前验证电路功能是否有效；（ASCI 设计中,这一步骤称为第一次 Sign-off）PLD 设计中,有时跳过这一步；3.设计编译；设计输入之后就有一个从高层次系统行为设计向门级逻辑电路设转化翻译过程,即把设计输入的某种或某几种数据格式 格式网表；网表 转化为软件可识别的某种数据4.优化；对于上述综合生成的网表,依据布尔方程功能等效的原就,用更小更快的综合
37、结果代替一些复杂的单元, 并与指定的库映射生成新的网表,条必由之路；这是减小电路规模的一5.布局布线； 在 PLD 设计中,3-5 步可以用 PLD 厂家供应的开发软件（如 Maxplus2）自动一次完成；名师归纳总结 - - - - - - -第 20 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆6.后仿真（时序仿真）需要利用在布局布线中获得的精确参数再次验证电路的时序；（ASCI 设计中,这一步骤称为其次次 Signoff ）；7.生产；布线和后仿真完成之后, 就可以开头 ASCI 或 PLD 芯片的投产7、IC 设计前端到后端的流程和eda
38、工具；（未知）规律设计 -子功能分解 -具体时序框图-分块规律仿真-电路设计RTL 级描述 -功能仿真 -综合加时序约束和设计库 -电路网表 -网表仿真 -预布局布线 SDF文件 -网表 仿真带延时文件 -静态时序分析-布局布线 -参数提取 -SDF 文件-后仿真 -静态时序分析 -测试向 量生成 -工艺设计与生产 -芯片测试-芯片应用,在验证过程中显现的时序收敛,功耗,面积问题,应 返回前端的代码输入进行重新修改,再仿真,再综合,再验证,一般都要反复好几次才能最终送去 foundry名师归纳总结 - - - - - - -第 21 页,共 45 页精选学习资料 - - - - - - - -
39、 - 学而不思就惘,思而不学就殆厂流片；9、Asic 的 design flow（设计流程）；（威盛 VIA 2003.11.06 上海笔试试题） 11、集成电路前段设计流程,写出相关的工具；先介绍下 IC 开发流程：1.）代码输入（ design input （扬智电子笔试）用 vhdl 或者是 verilog 语言来完成器件的功能描述,生成 hdl 代码语言输入工具： SUMMIT VISUALHDL MENTOR RENIOR 图形输入 : composercadence; viewlogic viewdraw 2.）电路仿真（ circuit simulation 将 vhd 代码进行
40、从前规律仿真,验证功能描述是否正确数字电路仿真工具：名师归纳总结 Verolog： CADENCE Verolig-XL 第 22 页,共 45 页SYNOPSYS VCS MENTOR Modle-sim - - - - - - -精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆VHDL : CADENCE NC-vhdl SYNOPSYS VSS MENTOR Modle-sim 模拟电路仿真工具：*ANTI HSpice pspice,spectre micro microwave: eesoft : hp 3.）规律综合（ synthesis tools 规
41、律综合工具可以将设计思想 手段的门级电路；将初级仿真中所没vhd 代码转化成对应肯定工艺有考虑的门沿（ gates delay）反标到生成的门级网表中 ,返回电路仿真阶段进行再仿真；最终仿真结果生成的网表称为物理网表；12、请简述一下设计后端的整个流程？（仕兰微面试题目）13、是否接触过自动布局布线？请说出一两种工具软件；自动布局布线需要哪些基本元素？（仕兰微面试题目）名师归纳总结 - - - - - - -第 23 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆Protel Protel99 是基于 Win95/Win NT/Win98/Win2
42、000 的纯 32 位电路设计制版系统； Protel99 供应了一个集成的设计环境,包括了原理图设计和 文档治理,支持通过网络进行工作组协同设计功能；PCB 布线工具,集成的设计14、描述你对集成电路工艺的熟识； （仕兰微面试题目）集成电路是采纳半导体制作工艺, 在一块较小的单晶硅片上制作上许 多晶体管及电阻器、电容器等元器件,并依据多层布线或遂道布线的方法将元器件组合成完整的电子电 路；它在电路中用字母“IC”（也有用文字符号“N” 等）表示；（一）按功能结构分类集成电路按其功能、结构的不同,可以分为模 拟集成电路和数字集成电路两大类；名师归纳总结 - - - - - - -第 24 页,共 45 页精选学习资料 - - - - - - - - - 学而不思就惘,思而不学就殆模拟集成电路用来产生、 放大和处理各种模拟信号 （指幅度随时间边疆变化的信号；例如半导体收音机的音频信号、录放机的磁带信号等） ,而数字集成电路用来产生、放大和处理各种数字信号