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1、Four short words sum up what has lifted most successful individuals above the crowd: a little bit more.-author-datesrtp项目申请表-(1)关于申报2015年“基于教师科研（含企业合作项目）的SRTP项目东南大学2015年基于教师科研（含企业合作项目）的SRTP项目申请表（校级重点专项）项目名称： (项目指南编号) 项目申报人： 所在院(系)： 项目所属一级学科： 专 业： 一卡通号： 联系电话： 电子信箱： 东南大学教务处制二一四年十一月项目名称（指南编号）：ZN2014080
2、076申报人及团队成员情况姓 名所在院系学 号李祖朝电子科学与工程学院061121131、项目简介：（研究内容、目的、意义，字数要求不少于500字）研究内容：利用压缩感知理论对接收信号高速率采样后的高阶统计量进行分析。目的： 1.对接收信号的高阶统计量直接进行奈奎斯特采样导致硬件成本较高，且增加信号特征参数估计算法的复杂度，从而不能很好地完成实时性参数估计和检测。新近提出的压缩感知理论可以较好地解决信号高速率采样的问题。2.利用压缩感知理论对接收信号高速率采样后的高阶统计量进行分析，可以较好地解决硬件成本高和信号特征参数估计算法复杂度高的问题，从而很好地完成实时性参数估计和检测。所选择的高阶循
3、环累积量的估计算法能够解决信号经过压缩采样后所失去了时域特征，以及频域上的交叠频谱问题。并有效降低在信道中不可避免存在各种各样的噪声影响。3.通过本项目的完成，可以进一步增强小组各成员对电子科学与技术专业的兴趣，增强对数字信号处理、集成电路设计理论的认识，更好地把握本专业的前沿动态；同时增进从MATLAB软件系统级仿真到Verilog HDL、针对FPGA硬件进行动手实践这一完整工程项目实现过程的认识与体会；通过本项目的完成，可以培养良好的编写程序的能力以及动手能力、项目组织管理、写作与口头表达等能力。 意义：本项目拟基于压缩感知设计一种高阶循环累积量估计算法，以远低于奈奎斯特采样速率对接收信
4、号进行欠采样，可以较好地解决硬件成本高和信号特征参数估计算法复杂度高的问题，从而很好地完成实时性参数估计和检测。利用压缩感知理论对接收信号高速率采样后的高阶统计量进行分析，可以较好地解决硬件成本高和信号特征参数估计算法复杂度高的问题，从而很好地完成实时性参数估计和检测。所选择的高阶循环累积量的估计算法能够解决信号经过压缩采样后所失去了时域特征，以及频域上的交叠频谱问题。并有效降低在信道中不可避免存在各种各样的噪声影响。在MATLAB软件平台上对高阶循环累积量估计算法进行系统级仿真。要求通过比较，所选择的这一估计算法，具有良好的抗噪声能力和对典型的调制信号如ASK、FSK、MPSK与MQAM等的
5、载波频率估计有很高的准确性；在对信号的五阶循环累积量稀疏度已知的情况下，重构出的五阶循环累积量其结果的误差较小。 2、项目指南索引指南编号指南名称来源及依托项目类别指南申报人ZN2014080076压缩感知辅助的多信号调制参数估计算法及其实现科研纵向其他国家工程研究中心理论研究张萌3、项目技术路线及可行性分析（不少于300字）本项目拟基于压缩感知设计一种高阶循环累积量估计算法，以远低于奈奎斯特采样速率对接收信号进行欠采样；计算压缩采样向量的各元素的高次幂；生成傅里叶系数矩阵、对角线投影矩阵、生成中间变量矩阵；建立压缩采样值与高阶循环累积量之间的数学关系；利用0范数最优化算法准确估计高阶循环累积
6、量。在MATLAB软件平台上对高阶循环累积量估计算法进行系统级仿真。要求通过比较，所选择的这一估计算法，具有良好的抗噪声能力和对典型的调制信号如ASK、FSK、MPSK与MQAM等的载波频率估计有很高的准确性；在对信号的五阶循环累积量稀疏度已知的情况下，重构出的五阶循环累积量其结果的误差较小。4、申报人及团队成员开展本项目的适宜度（200字）李祖朝： 会使用单片机和FPGA ，Verilog HDL、针对FPGA硬件进行动手实践能力比较强，能认真钻研！5、学科类别 工科 理科 医学 文科 管理类 其他6、预期成果形式（可选多项，每项注明件数及类别）；硬件设计与制作 软件设计 发表论文（篇数、刊
7、物级别） 申请专利 模型结构 实验研究 参加竞赛 成果应用其他形式：7、项目时间进度（按月度计划）、以及相应的经费使用预算科目与金额等十二月：了解并熟悉压缩感知理论，二月：计算压缩采样向量的各元素的高次幂；三月：生成傅里叶系数矩阵、对角线投影矩阵、生成中间变量矩阵；四月：建立压缩采样值与高阶循环累积量之间的数学关系；六月：利用0范数最优化算法准确估计高阶循环累积量。七月：在MATLAB软件平台上对高阶循环累积量估计算法进行系统级仿真八月之后：从MATLAB软件系统级仿真到Verilog HDL、针对FPGA硬件进行动手实践这一完整工程项目实现过程本项目研究经费预算为2万元，包括材料购置费、工具费、图书资料费、市内交通和差旅费、版面和专利申请费、办公用品费和复印印刷费等。院（系）推荐意见：院（系）教学院长：终审专家意见：评审组组长（签字）：年 月 日学校认定意见、批准经费： 学校负责人（签名）： 年 月 日-