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1、数字电路时钟触发器的逻辑功能第1页，共13页，编辑于2022年，星期六一、SR触发器：&CP R SCP=1期间，输出跟随输入状态的变化而变化,接收 CP=0期间，SR不会影响输出端状态,保持1.功能真值表：第2页，共13页，编辑于2022年，星期六动作特点:如果CP=1的期间内输入信号多次发生变化,则触发器的状态也会发生多次翻转,这就降低了电路的抗干扰能力.不定态，输出随输入而改变。第3页，共13页，编辑于2022年，星期六2.激励表：10SR0 10XX0013.状态图：描述触发器的状态转换关系及转换条件的图形第4页，共13页，编辑于2022年，星期六4.特性方程：就是触发器次态Qn+1与
2、输入及现态Qn之间的逻辑关系式第5页，共13页，编辑于2022年，星期六二、D触发器：&CPD第6页，共13页，编辑于2022年，星期六.状态图：D0 11100特点:无约束项即无不定态.第7页，共13页，编辑于2022年，星期六三、JK触发器：在时钟信号作用下,符合功能表所规定的逻辑功能者,叫_&K JCP第8页，共13页，编辑于2022年，星期六特点:无约束项即无不定态.第9页，共13页，编辑于2022年，星期六 状态图：JK0 11XX0X10X第10页，共13页，编辑于2022年，星期六四、T触发器：T&CP第11页，共13页，编辑于2022年，星期六 状态图：T0 11010特例：当T=1时为T触发器第12页，共13页，编辑于2022年，星期六作业：P227 9，12，13（不考虑延迟时间）第四版：P176 3,5P149 3，4 （看懂P149表格）第13页，共13页，编辑于2022年，星期六