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1、电子工程师笔试题目2006年 10 月 25 日 星期三 下午 11:42 模拟电路1、基尔霍夫定理的内容是什么？（仕兰微电子）基尔霍夫电流定律是一个电荷守恒定律,即在一个电路中流入一个节点的电荷与流出同一个节点的电荷相等.基尔霍夫电压定律是一个能量守恒定律,即在一个回路中回路电压之和为零.2、平板电容公式(C=S/4 kd)。（未知）3、最基本的如三极管曲线特性。（未知）4、描述反馈电路的概念，列举他们的应用。（仕兰微电子）5、负反馈种类（电压并联反馈，电流串联反馈，电压串联反馈和电流并联反馈）；负反馈的优点（降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效
2、地扩展放大器的通频带，自动调节作用）（未知）6、放大电路的频率补偿的目的是什么，有哪些方法？（仕兰微电子）7、频率响应，如：怎么才算是稳定的，如何改变频响曲线的几个方法。（未知）8、给出一个查分运放，如何相位补偿，并画补偿后的波特图。（凹凸）9、基本放大电路种类（电压放大器，电流放大器，互导放大器和互阻放大器），优缺点，特别是广泛采用差分结构的原因。（未知）10、给出一差分电路，告诉其输出电压Y+和 Y-,求共模分量和差模分量。（未知）11、画差放的两个输入管。（凹凸）12、画出由运放构成加法、减法、微分、积分运算的电路原理图。并画出一个晶体管级的运放电路。（仕兰微电子）13、用运算放大器组成
3、一个10 倍的放大器。（未知）14、给出一个简单电路，让你分析输出电压的特性（就是个积分电路），并求输出端某点的 rise/fall时间。(Infineon笔试试题)15、电阻 R和电容 C串联，输入电压为R 和 C之间的电压，输出电压分别为C 上电压和 R 上电压，要求制这两种电路输入电压的频谱，卸险饬街值缏泛挝咄 瞬鳎挝 屯?nbsp;波器。当 RCT时，给出输入电压波形图，绘制两种电路的输出波形图。（未知）16、有源滤波器和无源滤波器的原理及区别?（新太硬件）17、有一时域信号S=V0sin(2pif0t)+V1cos(2pif1t)+2sin(2pif3t+90),当其通过低通、带通、
4、高通滤波器后的信号表示方式。（未知）18、选择电阻时要考虑什么？（东信笔试题）19、在 CMOS 电路中，要有一个单管作为开关管精确传递模拟低电平，这个单管你会用P管还是 N 管，为什么？（仕兰微电子）20、给出多个mos管组成的电路求5 个点的电压。(Infineon笔试试题)21、电压源、电流源是集成电路中经常用到的模块，请画出你知道的线路结构，简单描述其优缺点。（仕兰微电子）22、画电流偏置的产生电路，并解释。（凹凸）23、史密斯特电路,求回差电压。（华为面试题）24、晶体振荡器,好像是给出振荡频率让你求周期(应该是单片机的,12 分之一周期.)（华为面试题）25、LC正弦波振荡器有哪几
5、种三点式振荡电路，分别画出其原理图。（仕兰微电子）26、VCO 是什么,什么参数(压控振荡器?)（华为面试题）27、锁相环有哪几部分组成？（仕兰微电子）名师资料总结-精品资料欢迎下载-名师精心整理-第 1 页，共 14 页 -28、锁相环电路组成，振荡器（比如用D 触发器如何搭）。（未知）29、求锁相环的输出频率，给了一个锁相环的结构图。（未知）30、如果公司做高频电子的，可能还要RF知识，调频，鉴频鉴相之类，不一一列举。（未知）31、一电源和一段传输线相连（长度为L,传输时间为T），画出终端处波形，考虑传输线无损耗。给出电源电压波形图，要求绘制终端波形图。（未知）32、微波电路的匹配电阻。（
6、未知）33、DAC和 ADC的实现各有哪些方法？（仕兰微电子）34、A/D 电路组成、工作原理。（未知）35、实际工作所需要的一些技术知识(面试容易问到)。如电路的低功耗，稳定，高速如何做到，调运放，布版图注意的地方等等,一般会针对简历上你所写做过的东西具体问，肯定会问得很细（所以别把什么都写上，精通之类的词也别用太多了），这个东西各个人就不一样了，不好说什么了。（未知）_ 数字电路1、同步电路和异步电路的区别是什么？（仕兰微电子）2、什么是同步逻辑和异步逻辑？（汉王笔试）同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。3、什么是 线与 逻辑，要实现它，在硬件特性上
7、有什么具体要求？（汉王笔试）线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc 门来实现，由于不用 oc 门可能使灌电流过大，而烧坏逻辑门。同时在输出端口应加一个上拉电阻。4、什么是Setup 和 Holdup 时间？（汉王笔试）5、setup 和 holdup 时间,区别.（南山之桥）6、解释 setup time和 hold time的定义和在时钟信号延迟时的变化。（未知）7、解释 setup 和 hold time violation，画图说明，并说明解决办法。（威盛VIA2003.11.06 上海笔试试题）Setup/hold time 是测试芯片对输入信号和时钟信号之间的
8、时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T 时间到达芯片，这个T 就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time 不够，数据同样不能被打入触发器.建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保
9、持时间的话，那么DFF将不能正确地采样到数据，将会出现 metastability的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间，那么超过量就分别被称为建立时间裕量和保持时间裕量。8、说说对数字逻辑中的竞争和冒险的理解，并举例说明竞争和冒险怎样消除。（仕兰微电子）9、什么是竞争与冒险现象？怎样判断？如何消除？（汉王笔试）在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。10、你知道那些常用逻辑电平？TTL 与 COMS
10、 电平可以直接互连吗？（汉王笔试）名师资料总结-精品资料欢迎下载-名师精心整理-第 2 页，共 14 页 -常用逻辑电平：12V，5V，3.3V；TTL 和 CMOS 不可以直接互连，由于TTL 是在 0.3-3.6V之间，而 CMOS 则是有在12V 的有在 5V 的。CMOS 输出接到TTL 是可以直接互连。TTL 接到 CMOS 需要在输出端口加一上拉电阻接到5V 或者 12V。11、如何解决亚稳态。（飞利浦大唐笔试）亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。在这个稳定期
11、间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去。12、IC 设计中同步复位与异步复位的区别。（南山之桥）13、MOORE 与 MEELEY状态机的特征。（南山之桥）14、多时域设计中,如何处理信号跨时域。（南山之桥）15、给了 reg 的 setup,hold时间，求中间组合逻辑的delay 范围。（飞利浦大唐笔试）Delay q,还有 clock的 delay,写出决定最大时钟的因素，同时给出表达式。（威盛VIA 2003.11.06 上海笔试试题）18、说说静态、动态时序模拟的优缺点。（威盛VIA 2003.11.06
12、上海笔试试题）19、一个四级的Mux,其中第二级信号为关键信号如何改善timing。（威盛VIA2003.11.06 上海笔试试题）20、给出一个门级的图，又给了各个门的传输延时，问关键路径是什么，还问给出输入，使得输出依赖于关键路径。（未知）21、逻辑方面数字电路的卡诺图化简，时序（同步异步差异），触发器有几种（区别，优点），全加器等等。（未知）22、卡诺图写出逻辑表达使。（威盛VIA 2003.11.06 上海笔试试题）23、化简 F(A,B,C,D)=m(1,3,4,5,10,11,12,13,14,15)的和。（威盛）24、please show the CMOS inverter s
13、chmatic,layout and its cross sectionwith P-well process.Plot its transfer curve(Vout-Vin)And also explain the operation region of PMOS and NMOS for each segment of the transfer curve?（威盛笔试题c ircuit design-beijing-03.11.09）25、To design a CMOS invertor with balance rise and fall time,please define th
14、e ration of channel width of PMOS and NMOS and explain?26、为什么一个标准的倒相器中P 管的宽长比要比N管的宽长比大？（仕兰微电子）27、用 mos管搭出一个二输入与非门。（扬智电子笔试）28、please draw the transistor level schematic of a cmos 2 input AND gate and explain which input has faster response for output rising edge.(less delay tim e)。（威盛笔试题circuit desig
15、n-beijing-03.11.09）29、画出 NOT,NAND,NOR 的符号，真值表，还有transistor level的电路。（Infineon笔试）30、画出 CMOS 的图，画出tow-to-one mux gate。（威盛 VIA 2003.11.06 上海笔试试题）名师资料总结-精品资料欢迎下载-名师精心整理-第 3 页，共 14 页 -31、用一个二选一mux和一个 inv 实现异或。（飞利浦大唐笔试）32、画出 Y=A*B+C的 cmos电路图。（科广试题）33、用逻辑们和cmos 电路实现ab+cd。（飞利浦大唐笔试）34、画出 CMOS 电路的晶体管级电路图，实现Y=
16、A*B+C(D+E)。（仕兰微电子）35、利用 4 选 1 实现 F(x,y,z)=xz+yz。（未知）36、给一个表达式f=xxxx+xxxx+xxxxx+xxxx用最少数量的与非门实现（实际上就是化简）。37、给出一个简单的由多个NOT,NAND,NOR 组成的原理图，根据输入波形画出各点波形。（Infineon笔试）38、为了实现逻辑（A XOR B）OR（C AND D），请选用以下逻辑中的一种，并说明为什么？1）INV 2）AND 3）OR 4）NAND 5）NOR 6）XOR 答案：NAND（未知）39、用与非门等设计全加法器。（华为）40、给出两个门电路让你分析异同。（华为）41
17、、用简单电路实现，当A为输入时，输出B波形为（仕兰微电子）42、A,B,C,D,E进行投票，多数服从少数，输出是F（也就是如果A,B,C,D,E中 1 的个数比0 多，那么F 输出为 1，否则 F 为 0），用与非门实现，输入数目没有限制。（未知）43、用波形表示D触发器的功能。（扬智电子笔试）44、用传输门和倒向器搭一个边沿触发器。（扬智电子笔试）45、用逻辑们画出D 触发器。（威盛VIA 2003.11.06 上海笔试试题）46、画出 DFF的结构图,用 verilog实现之。（威盛）47、画出一种CMOS 的 D锁存器的电路图和版图。（未知）48、D触发器和D 锁存器的区别。（新太硬件面
18、试）49、简述 latch和 filp-flop的异同。（未知）50、LATCH 和 DFF的概念和区别。（未知）51、latch与 register的区别,为什么现在多用register.行为级描述中latch如何产生的。（南山之桥）52、用 D 触发器做个二分颦的电路.又问什么是状态图。（华为）53、请画出用D触发器实现2 倍分频的逻辑电路？（汉王笔试）54、怎样用D 触发器、与或非门组成二分频电路？（东信笔试）55、How many flip-flop circuits are needed to divide by 16?(Intel)16分频？56、用 filp-flop和 logi
19、c-gate设计一个1 位加法器，输入carryin和 current-stage，输出carryout和 next-stage.（未知）57、用 D 触发器做个4 进制的计数。（华为）58、实现 N 位 Johnson Counter,N=5。（南山之桥）59、用你熟悉的设计方式设计一个可预置初值的7 进制循环计数器，15 进制的呢？（仕兰微电子）60、数字电路设计当然必问Verilog/VHDL，如设计计数器。（未知）61、BLOCKING NONBLOCKING 赋值的区别。（南山之桥）62、写异步D 触发器的 verilog module。（扬智电子笔试）module dff8(clk
20、,reset,d,q);名师资料总结-精品资料欢迎下载-名师精心整理-第 4 页，共 14 页 -input clk;input reset;input 7:0 d;output 7:0 q;reg 7:0 q;always (posedge clk or posedge reset)if(reset)q=0;else q=d;endmodule 63、用 D 触发器实现2 倍分频的Verilog描述？（汉王笔试）module divide2(clk,clk_o,reset);input clk,reset;output clk_o;wire in;reg out;always (posedg
21、e clk or posedge reset)if(reset)out=0;else out=in;assign in=out;assign clk_o=out;endmodule 64、可编程逻辑器件在现代电子设计中越来越重要，请问：a)你所知道的可编程逻辑器件有哪些？b)试用 VHDL或 VERILOG、ABLE描述 8 位 D触发器逻辑。（汉王笔试）PAL，PLD，CPLD，FPGA。module dff8(clk,reset,d,q);input clk;input reset;input d;output q;reg q;always (posedge clk or posedge
22、reset)if(reset)q=0;else q=0&a=0？100层楼，两个鸡蛋。某层之上扔鸡蛋就会碎。问至少要测试多少次才能试出这个层数。25匹马，每次比赛可选5 匹马赛出次序（无法计时）。问至少要比赛多少次才能确定跑得最快，次快和第三快的三匹马。七场,过程如下:125 马分组跑完，这样各组都有.名的排列,类似于如下的排列,这样就是跑了 5 次了，再把各组第一名组成一个组跑,这样产生的第一名一定是整个25 个马中的第一名.余下的第二名的产生,只能是 B和 1 这两个马.余下第三名的产生,只可能为 C和 21 或者 a 和 2 和 B,这样,将 B C 1 2 a 这五个马组成.于是共计
23、7 场 E a b c d e.上台阶，每次可走一台阶和两台阶，问上10 个台阶有多少种走法？还有道考概率的题，光问题描述就写了半页纸，题讲什么忘了，当时依稀感觉好像又进了考研英语的考场。第二部分大题三道，一道15 分，1：插入一个节点到一个有序链表。2：循环的有序数组（比如1，2，3，4，5，-3，-2，-1 这种数列）里查找一个数3：在一个正整数序列中求和最大的非相邻子序列（序列任两元素在原序列里都不相邻）第三部分写个 200350 words 的 essay：你认为近两百年来最重要的三项发明是什么，说出你的理由，第二部分的大题花时间太多，瞎写的electricity,nuclear weapon,computer。后来听说 EMC 全国只招两位数的人，所以权当给牛人当陪练了。名师资料总结-精品资料欢迎下载-名师精心整理-第 13 页，共 14 页 -名师资料总结-精品资料欢迎下载-名师精心整理-第 14 页，共 14 页 -