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1、第四章 组合逻辑电路4.1 概述 4.2 组合逻辑电路的分析方法和设计方法4.3 若干常用组合逻辑电路4.4 组合逻辑电路中的竞争-冒险现象4.1概 述组合逻辑电路的特点组合逻辑电路组合逻辑电路：任何时刻，：任何时刻，输出状态输出状态只决定于只决定于同一时刻同一时刻的的输入状态的组合输入状态的组合，而与电路，而与电路原来状原来状态无关态无关的的逻辑电路。的的逻辑电路。4.2.1 组合逻辑电路的分析方法分析步骤：1. 由逻辑图逐级写出各输出端的逻辑表达式2. 化简（最简与或式）和变换各逻辑表达式3. 列出真值表4. 根据真值表和逻辑表达式对电路进行分析，并确定电路的功能4.2 组合逻辑电路的分析
2、方法和设计方法4.2.2 组合逻辑电路的设计过程设计步骤： 1.设计一个表决电路，要求输出信号的电平与三个输入信号中的多数电平一致。 2.用与非门设计四变量的多数表决电路。当输入变量A，B，C，D有3个或3个以上为1时输出为1，输入为其他状态时输出为0.3.交通信号灯的正常工作状态与故障状态 4.设计一个路灯控制电路，要求实现的功能是：当总电源开关闭合时，安装在三个不同地方的三个开关都能独立地将灯打开或熄灭；当总电源开关断开时，路灯不亮。4.3 若干常用组合逻辑电路若干常用组合逻辑电路输入输出I0I1I2I3I4I5I6I7Y2Y1Y010000000000010000000010010000
3、00100001000001100001000100000001001010000001011000000001111二、优先编码器 在优先编码器电路中，在优先编码器电路中，允许同时输入两个允许同时输入两个以上的编码信号以上的编码信号。 不过在设计优先编码器是已经将所有的输不过在设计优先编码器是已经将所有的输入信号按优先顺序排了队，当几个输入信号同入信号按优先顺序排了队，当几个输入信号同时时出现时，只对其中出现时，只对其中优先权最高优先权最高的一个进行编码。的一个进行编码。8线线3线优先编码器线优先编码器74LS148的逻辑图的逻辑图功能分析：功能分析：1.S片选端（选通输入端）片选端（选通输
4、入端）S=0时，正常工作；时，正常工作；S=1时，所有输出为高电平。时，所有输出为高电平。2.YS无编码指示端（选通无编码指示端（选通输出端）输出端）YS=0时，表示电路工作，但时，表示电路工作，但无编码输入；无编码输入；YS=1，且，且S=0时，表示电路时，表示电路工作且有编码。工作且有编码。3.YEX扩展端扩展端YEX=0时，表示电路工作，且时，表示电路工作，且有编码输入；有编码输入；YEX=1，且，且S=0时，表示电时，表示电路工作但无编码。路工作但无编码。S I0I1I2I3I4I5I6I7Y2Y1Y0YSYEX1X XXXXXXX11111011111111111010X XXXXX
5、X0000100X XXXXX01001100X XXXX011010100X XXX0111011100X XX01111100100X X011111101100X01111111101000111111111110用两片74LS148接成的16线4线优先编码器二十进制优先编码器二十进制优先编码器74LS147的逻辑图的逻辑图4.3.2 译码器译码：译码：将具有特定含义的输入代码转换成相应的输出将具有特定含义的输入代码转换成相应的输出信号信号译码器：译码器：实现译码功能的逻辑电路。实现译码功能的逻辑电路。译码器主要有二进制、二译码器主要有二进制、二十进制等。十进制等。1.二进制译码器二进制
6、译码器输入：输入：二进制代码；二进制代码；输出：输出：与代码一一对与代码一一对应的高低电平信号。应的高低电平信号。用二极管与门阵列组成的3线8线译码器用与非门组成的3线8线译码器74LS138用两片74LS138接成的4线16线译码器2.二十进制译码器74LS423.显示译码器（1）半导体数码管BS201A （a）外形图 （b）等效电路（2） 液晶显示器的结构及符号（a）未加电场时 （b）加电场以后 （c）符号BCD七段显示译码器7448的逻辑图3.用二进制译码器实现组合逻辑函数（一）基本原理（一）基本原理（1） 二进制译码器的特点功能特点：二进制译码器的输出端提供了输入变量的全部最小项。电路
7、结构特点：译码器的基本电路是由与门组成的阵列。（2） 组合逻辑函数的标准与非与非式（二）基本步骤（二）基本步骤（1） 选择集成二进制译码器函数变量数与译码器输入二进制代码位数相等。（2） 写出函数的标准与非与非式（3） 确认译码器和与非门输入信号的表达式 （4） 画连线图例：74LS138：3线8线ABCCBCBAZCBABAZCBABCZCBABCACAZ43214.3.3 数据选择器数据选择器输入数据选择控制信号在多路数据传送过程中，能够根据需要将其中任意一路挑选出来的电路，叫做数据选择器，也称为多路选择器或多路开关。采用CMOS传输门结构的数据选择器CC14539双4选1数据选择器74L
8、S153用两个4选1数据选择器接成的8选1数据选择器用数据选择器实现组合逻辑函数用数据选择器实现组合逻辑函数（一）基本原理（一）基本原理1.数据选择器输出信号逻辑表达式的一般形式数据选择器输出信号逻辑表达式的一般形式2.数据选择器输出信号逻辑表达式的主要特点数据选择器输出信号逻辑表达式的主要特点具有标准与或表达式的形式；提供了地址变量具有标准与或表达式的形式；提供了地址变量的全部最小项；一般情况下，的全部最小项；一般情况下，Di可当成一个变可当成一个变量处理；受选通信号控制。量处理；受选通信号控制。3.组合逻辑函数的标准表达形式组合逻辑函数的标准表达形式（二）基本步骤（二）基本步骤1. 确定应
9、选用的数据选择器确定应选用的数据选择器 2.根据根据n=k-1或或n=k确定数据选择器的类型和型号确定数据选择器的类型和型号，n是选择器地址码，是选择器地址码，k是函数的变量个数。是函数的变量个数。 3.写逻辑表达式写逻辑表达式 写出函数的标准与或表达式和选择器输出信号写出函数的标准与或表达式和选择器输出信号的表达式。的表达式。 4.求选择器输入变量的表达式求选择器输入变量的表达式 5.画连线图画连线图应用举例:74LS151八选一；74LS153双四选一；74LS150十六选一1.画出用数据选择器实现函数Y=AB+BC+CA的连线图.例4.3.5 试用4选1数据选择器实现交通信号灯监视电路。
10、例4.3.6 试用8选1数据选择器产生三变量逻辑函数RAGGRAGARAGRGARZBCAACCBAZ4.3.4 加法器一、1位加法器（一）半加器 半加器:半加器是不考虑低位进位的一位二进制加法器。 （二）全加器全加器是考虑了低位进位的一位二进制加法器双全加器74LS183 （a）1/2逻辑图 （b）图形符号4位串行进位加法器 把全加器的进位输出接下一位全加器的进位输入，可构成多位加法器。 对于串行对于串行4位加法器，从数据给出到得出结果，约需位加法器，从数据给出到得出结果，约需4个全加器的延时，因为高位的加运算只有在低位运算个全加器的延时，因为高位的加运算只有在低位运算结果（进位输出）得出后
11、才能进行，所以速度较慢。结果（进位输出）得出后才能进行，所以速度较慢。4位超前进位加法器74LS283 的逻辑图 实际上，加法电路中各位实际上，加法电路中各位的进位信号由专门的进位信的进位信号由专门的进位信号产生电路（进位门）同时号产生电路（进位门）同时产生。产生。 只要各位数据和最低位进只要各位数据和最低位进位同时输入，各位之间的进位同时输入，各位之间的进位信号与和就能同时产生。位信号与和就能同时产生。 3.2.2 数值比较器一、1位数值比较器二、二、 多位二进制比较，如果高位已比较出多位二进制比较，如果高位已比较出“”或或“B=YA=B+YAB4.4 组合逻辑电路中的竞争冒险现象4.4.1
12、 竞争冒险现象及其成因由于竞争而产生的尖峰脉冲将门电路两个输入信号同时向相反的逻辑电平跳变（一个从1变为0，另一个从0变为1）的现象称为竞争由于竞争而在电路输出端可能产生尖峰脉冲的现象称为竞争-冒险。竞争-冒险产生的原因：1.信号A、B不可能突变，状态改变要经历一段极短的过渡时间。2.信号A、B改变状态的时间有先有后，因为它们经过的传输路径长短不同，门电路的传输时间也不可能完全一样。 2线4线译码器中的竞争冒险现象 （a）电路图 （b）电压波形图同一输入变量经不同途径到达输出门的情况（m、n 均为正整数）4.4.2 检查竞争冒险现象的方法在输入变量每次只有一个改变状态的情况下，可以通过逻辑函数式判断组合逻辑电路是否有竞争冒险现象的存在。这种方法虽然简单，但局限性太大，因为多数情况下输入变量都有两个以上同时改变状态的可能性。如果输入变量的数目有很多，就更难从逻辑函数式上简单地找出所有竞争-冒险现象的情况了。4.4.3 消除竞争冒险现象的方法（a）电路接法 （b）电压波形用增加冗余项消除竞争冒险当竞争冒险是由单个变量改变状态引起时，则可用增加冗余项的方法予以消除。