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1、电量采集终端硬件电路设计1 CPU 电路设计1.1 概述CPU电路主要包括供电电路，晶振电路，复位电路及JTAG电路组成。具体电路见图 1-1。图 1-1 CPU 电路1.2 系统的供电电路STR711FR0 处理器需要两路电源供电，一路3.3V，一路 1.8V。其中 3.3V 的电源供给 V33：外部主电源 V33IOPLL： 数字 I/O 电路和 PLL电路的 3.3V 参考电源 VDDAD：A/D转换器的参考电压1.8V 的电源则供给 V18：处理器内核电源名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 -
2、- - - - - - 第 1 页，共 9 页 - - - - - - - - - 本电路中的外部3.3V 电源是通过电源板提供的VCC （5V）电源经过线性稳压器 LM1117-3.3（U6 ）获得，具体的电路见图1-1 左下角，其中 U6为线性稳压芯片，而 C22和 E3则是为了确保 LM1117输出的稳定性。 由于 STR711FR0 内部集成了 1.8V 的电源稳压器， 所以并不需要再增加额外的1.8V 的线性稳压器， 只需要在 V18引脚处外接 100nF的退藕电容即可。为了减低电源上的纹波对整个系统的影响，需要在所有电源的引脚处并接100nF 的退藕电容。（具体可以参照图1-1）
3、。注意：1.在正常操作模式下V18 与 V18BKP 短接，在 Standby模式下 V18 域与 V18BKP 域断开。2.V18 引脚不能连接到外部1.8V 电源。1.3 时钟电路STR711FR0 为选择主时钟和外围时钟提供了灵活的方式，芯片有3 个时钟源：1. PRCCU产生供给 CPU 和芯片外围的内部时钟。 PRCCU 可以由外部的脉冲产生器驱动，连接到CK 引脚上面。2. 32KHZ 晶振的实时时钟连接到内部的CK_AF 信号上，并且当需要低功率操作时可以选择这个时钟源。3. 如果需要连接 USB 特性的设备时需要USB 时钟源。1.3.1 时钟控制单元STR71X 时钟控制单元
4、必须由连接到CK 引脚上的晶体振荡器驱动， 此振荡器最高频率为频率16MHZ，它产生的时钟信号供给CPU 和芯片外围电路。 倍频和分频因子使得输入频率有更多的选择范围，然而，更加注意的是推荐频率的限制。在 DW710C 设计中，我们采用的是16M 有源晶振。具体见图1-1 中 X6 部分电路，其中 R10 保证有源晶体振荡器始终处在工作状态。1.3.2 实时时钟实时时钟的工作频率为32KHZ。这个时钟必须由外部产生电路提供，见图1-1 中 X1 部分电路，其中 C1 和 C2 为起振电容， X1 为 32.768KHZ 的晶体。RTC 用于产生一个时钟基准，当需要低功率操作时该时钟能够被选择。
5、1.4 复位管理总电压调节器和低电压调节器包含一个LVD（低电压检测） ，当 V18 或V18BKP 低于相应的控制电压（即低于1.35V10%）时，它们处于复位状态。LVD 不能检测 V33 脚上的电压，此电压供给芯片上的IO 口和模拟部分。注意： 1. 在芯片上电期间，复位必需由外部的复位电路提供。2. 在上电期间，nRSTIN 脚必需由外部电路保持低， 直到 V33 脚的电压稳定。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页，共 9 页 - - - - - - - -
6、 - 如图 1-1 所示，我们用的复位芯片是CAT809，它可以给 CPU 提供可靠的复位。1.5 启动管理STR71X 有三种可用的引导模式，分别三个输入管脚控制，即BOOTTEN，BOOT0 和 BOOT1 管脚。表 1-1 引导模式配置BOOTEN BOOT0 BOOT1 启动模式0 从内部 FLASH 启动1 0 0 1 1 0 保留1 0 1 从内部 RAM 启动1 1 1 从外部内存启动，在0000 0000h 地址上映射到EMI 接口在正常的应用中，程序是烧写到内部FLASH 中，所以我们采用第一中启动模式，把管脚 BOOTEN 通过一个 10K 的电阻下拉到地，这样可以节省出两
7、条口线。1.6 DEBUG管理主机/目标板接口是将开发板连接到主机的硬件设备，它由三部分组成：硬件调试工具（比如IAR 公司提供的 J-Link） 、JTAG 连接器和一条连接调试工具和主机的电缆。图1-2 展示了如何把电路板连接到主机。图 1-2 调试平台1.6.1 ICE 调试工具ICE 调试工具作为调试接口（图1-2 所示） ，它将电路板板连接到PC机上。嵌入式的ICE 是一个智能型的主机接口，它可以提供到主机调试程序的高速连接，可以访问开发板芯片上的模拟和调试模块。当你把电路板作为一个独立系统使用时， ICE 调试工具还可以用来烧写程序。1.6.2 JTAG/ICE 连接器名师资料总结
8、 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页，共 9 页 - - - - - - - - - ICE 连接器支持 JTAG 硬件调试设备（比如J-Link）连接到电路板上。它能够驱动和感知系统复位线，并且驱动JTAG 复位。JTAG 口用于调试程序和下载程序到处理器的FLASH 中。如图 1-1 中 JP1是 20p 的 JTAG 插座所以引脚定义均为ARM 公司的标准定义， JTDI、JTMS、JTCK、JTDO、JTRST和处理器的对应引脚相连。为提高JTAG 接口电路的稳定性，需
9、要在 JTAG 口加上 10K 的上拉电阻。2 外围电路设计2.1 概述外围电路包括按键、指示灯、红外电路、液晶屏接口、时钟芯片、通讯电路等，它们完成了人机接口功能、数据采集存储功能。2.2 按键与指示灯图 2-1 按键与指示灯电路按键电路设计比较简单，将按键的引线连接到处理器的通用I/O 上，R50 、R51和 R52为上拉电阻， C6、C7和 C8的作用则是为消除按键上的抖动。发光二极管只需要串联1 个限流电阻和处理器的通用I/O 相连即可。限流电阻的计算公式为：R （电源电压发光二极管压降）/ 二级管的工作电流发光二极管的压降一般为1.8V。在这里还需要考虑处理器I/O 口的最大吸名师资
10、料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 4 页，共 9 页 - - - - - - - - - 收电流。2.3 液晶显示电路此液晶显示电路针对于串行接口设计的，其中三极管NPN和电阻 R3组成了背光电路。电阻R49和电解电容 E6组成了液晶上电复位电路。其他的引脚连接可以参考液晶屏的技术手册。图 2-2 液晶显示电路2.4 SPI FLASH 电路图 2-3 SPI FLASH 电路采集器终端运行中需要保存大量的历史月数据和历史日数据。本电路中选用Atmel 公司的 AT45DB1
11、61D （2MB ）串行 FLASH 芯片下图为 FLASH 存储器，保存必要的各种数据。电路的连接如图2-3 所示。 SPI 接口线（ MOSI 、MISO 、SCLOCK和 CS ）跟处理器相应的引脚相连，RP2是 SPI 总线的上拉电阻。 WP 是串行存贮器的写保护引脚， WP 接高电平是写保护功能失效。WP 接低电平时，处理器无法名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 5 页，共 9 页 - - - - - - - - - 写入数据到串行存储器中，起到保护数据的作用。
12、由于我们需要实时对FLASH进行读写，所以在该电路中我们没有使用硬件写保护功能，WP脚直接通过排阻接到 3.3V。2.5 实时时钟电路图 2-4 实时时钟电路 DW710C 电路中的实时时钟芯片采用美信公司的DS1302 ， DS1302是一种高性能、低功耗、带RAM 的实时时钟芯片，它可以对年、月、日、周日、时、分、秒进行计时， 具有闰年补偿功能， 工作电压为 2.5V5.5V。采用三线接口与CPU进行同步通信，并可采用突发方式一次传送多个字节的时钟信号或RAM数据。DS1302内部有一个 318的用于临时性存放数据的RAM 寄存器。具有主电源 / 后背电源双电源引脚，同时提供了对后背电源进
13、行涓细电流充电的能力。DS1302的引脚中 Vcc为后备电源， VCC2为主电源。在主电源关闭的情况下，也能保持时钟的连续运行。 DS1302由 Vcc或 Vcc2两者中的较大者供电。 当 Vcc2大于 Vcc0.2V 时，Vcc2给 DS1302供电。当 Vcc2小于 Vcc时，DS1302由 Vcc供电。X1 和 X2 是振荡源，外接 32.768kHz 晶振。 RST是复位 / 片选线，通过把RST输入驱动置高电平来启动所有的数据传送。 RST输入有两种功能：首先， RST接通控制逻辑，允许地址 /命令序列送入移位寄存器； 其次，RST提供终止单字节或多字节数据的传送手段。当 RST为高
14、电平时，所有的数据传送被初始化，允许对DS1302进行操作。如果在传送过程中 RST置为低电平，则会终止此次数据传送，I/O 引脚变为高阻态。上电运行时，在 Vcc2.5V 之前，RST必须保持低电平。只有在SCK 为低电平时，才能将 RST置为高电平。 DA为串行数据输入输出端 ( 双向)，SCK始终是输入端。具体的电路见图 2-3 和图 2-4. 由于处理器的 IIC 接口内部电路为开漏设计，所以必须在 SCK 和 DA接上上拉电阻，即图 2-3 中的 RP2 。 电阻的阻值在 1.8K-4.7K之间选择，如果IIC 总线速度高的时间可以用1.8K，需要减少上拉电阻带来的功耗时，可以选用4
15、.7K。2.6 485 通信电路2.6.1 485 通讯芯片的选取在此应用系统中，选取两片TI 公司的 485 芯片 SN65LBC184，一路 485用于与上位机的通讯，另一路485 用于与电能表的通讯，采集电能表的电量。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 6 页，共 9 页 - - - - - - - - - 图 2-5 485通信电路2.6.2 隔离光耦电路的参数选取在应用系统中， 由于要对现场情况进行实时监控及响应，通信数据的波特率往往做得较高（通常都在4800
16、波特以上）。限制通信波特率提高的“瓶颈” ，并不是现场的导线（现场施工一般使用5 类非屏蔽的双绞线），而是在与嵌入式系统进行信号隔离的光耦电路上。此处采用TLP521。电路设计中可以考虑采用高速光耦，如 6N137、6N136 等芯片（但是价格比较贵） ，也可以优化普通光耦电路参数的设计，使之能工作在最佳状态。例如：光耦的发光二极管的驱动电阻，如果选取得较大， 将会使光耦的发光管由截止进入饱和变得较慢；如果选取得过小，退出饱和也会很慢， 所以这两只电阻的数值要精心选取，不同型号的光耦及名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - -
17、- 名师精心整理 - - - - - - - 第 7 页，共 9 页 - - - - - - - - - 驱动电路使得这两个电阻的数值略有差异，这一点在电路设计中要特别慎重，不能随意，通常可以由实验来定。2.6.3 485总线输出电路部分的设计输出电路的设计要充分考虑到线路上的各种干扰及线路特性阻抗的匹配。由于工程环境比较复杂， 现场常有各种形式的干扰源， 所以 485总线的传输端一定要加有保护措施。在本电路中选用能抗雷击的485 芯片 SN65LBC184。考虑到线路的特殊情况（如某一台分机的485 芯片被击穿短路），为防止总线中其它分机的通信受到影响，在SN65LBC184 的 485 信
18、号输出端串联了两个10的电阻。这样本机的硬件故障就不会使整个总线的通信受到影响。在应用系统工程的现场施工中，由于通信载体是双绞线，它的特性阻抗为120左右，所以线路设计时，在RS-485 网络传输线的始端和末端各应接1 只120的匹配电阻（ R37 和 R41） ，以减少线路上传输信号的反射。由于 RS-485芯片的特性， 接收器的检测灵敏度为200mV，即差分输入端VAVB +200mV，输出逻辑 1，VAVB 200mV，输出逻辑 0；而 A、B 端电位差的绝对值小于200mV 时，输出为不确定。如果在总线上所有发送器被禁止时，接收器输出逻辑0，这会误认为通信帧的起始引起工作不正常。解决这
19、个问题的办法是人为地使A 端电位高于 B 两端电位，这样 RXD 的电平在 485总线不发送期间 （总线悬浮时） 呈现唯一的高电平， 处理器就不会被误中断而收到乱字符。通过在 485电路的 A、B 输出端加接上拉、下拉电阻，即可很好地解决这个问题。2.7 红外电路名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 8 页，共 9 页 - - - - - - - - - 图 2-6 红外电路红外电路分为两个部分设计红外接受和红外发送电路。具体的电路见图2-6 所示。根据技术指标的要求，红外
20、的传输距离要求达到10 米，所以在本设计中采用 5V供电的红外接受和发送的器件。图2-5 中的有关红外的光电隔离电路主要实现电平转换的功能。红外发送电路需要38K 的震荡源，在本电路中采用晶体和反相器实现震荡源，图 2-6 中 U4C和 X2构成 38K的震荡电路。然后通过与非门将需要传输的数据与 38K震荡信号合成，通过红外发射管（D5和 D6 ）将信号发射出去。红外接受电路采用HS0038高灵敏度的接受芯片， 通过驱动后传输给处理器。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 9 页，共 9 页 - - - - - - - - -